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参数资料
| 型号： | ICS87159AGLFT |
| 厂商： | IDT, Integrated Device Technology Inc |
| 文件页数： | 3/17页 |
| 文件大小： | 0K |
| 描述： | IC CLOCK GEN 1-8 LVCMOS 56-TSSOP |
| 标准包装： | 1,000 |
| 系列： | HiPerClockS™ |
| 类型： | 时钟发生器 |
| PLL： | 无 |
| 输入： | HCSL，LVDS，LVHSTL，LVPECL，SSTL |
| 输出： | HCSL，LVCMOS，LVTTL |
| 电路数： | 1 |
| 比率 - 输入:输出： | 1:9 |
| 差分 - 输入:输出： | 是/是 |
| 频率 - 最大： | 600MHz |
| 除法器/乘法器： | 是/是 |
| 电源电压： | 3.135 V ~ 3.465 V |
| 工作温度： | 0°C ~ 85°C |
| 安装类型： | 表面贴装 |
| 封装/外壳： | 56-TFSOP（0.240"，6.10mm 宽） |
| 供应商设备封装： | 56-TSSOP |
| 包装： | 带卷 (TR) |
| 其它名称： | 87159AGLFT |
87159AG
www.idt.com
REV. B JULY 25, 2010
ICS87159
1-TO-8 LVPECL-TO-HCSL
÷1, ÷2, ÷4 CLOCK GENERATOR
11
Power and Ground
This section provides a layout guide related to power, ground
and placement of bypass capacitors for a high-speed digi-
tal IC. This layout guide is a general recommendation. The
actual board design will depend on the component types
being used, the board density and cost constraints. The
description assumes that the board has clean power and
ground planes. The principle is to minimize the ESR be-
tween the clean power/ground plane and the IC power/
ground pin.
A low ESR bypass capacitor should be used on each power
pin. The value of bypass capacitors ranges from 0.01uF to
0.1uF. The bypass capacitors should be located as close
IC
C
VIA
GND Pin
Power
Pin
GND
Pads
POWER
Pads
FIGURE 4. RECOMMENDED LAYOUT OF BYPASS CAPACITOR PLACEMENT
to the power pin as possible. It is preferable to locate the
bypass capacitor on the same side as the IC. Figure 4 shows
suggested capacitor placement. Placing the by-
pass capacitor on the same side as IC allows the capaci-tor
to have direct contact with the IC power pin. This can avoid
any vias between the bypass capacitor and the IC power
pins.
The vias should be place at the Power/Ground pads. There
should be minimum one via per pin. Increase the number of
vias from the Power/Ground pads to Power/Ground planes
can improve the conductivity.
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PDF描述 |
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