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参数资料
| 型号： | ICS8731CY-01LF |
| 厂商： | IDT, Integrated Device Technology Inc |
| 文件页数： | 16/17页 |
| 文件大小： | 0K |
| 描述： | IC CLOCK ULT/ZD BUFFER 48-LQFP |
| 标准包装： | 250 |
| 系列： | HiPerClockS™ |
| 类型： | 时钟倍频器，零延迟缓冲器 |
| PLL： | 带旁路 |
| 输入： | HCSL，LVDS，LVHSTL，LVPECL，SSTL |
| 输出： | LVPECL |
| 电路数： | 1 |
| 比率 - 输入:输出： | 1:11 |
| 差分 - 输入:输出： | 是/是 |
| 频率 - 最大： | 700MHz |
| 除法器/乘法器： | 是/是 |
| 电源电压： | 3.135 V ~ 3.465 V |
| 工作温度： | 0°C ~ 70°C |
| 安装类型： | 表面贴装 |
| 封装/外壳： | 48-LQFP |
| 供应商设备封装： | 48-TQFP（7x7） |
| 包装： | 托盘 |
| 其它名称： | 8731CY-01LF |
8731CY-01
www.idt.com
REV. B JULY 27, 2010
8
ICS8731-01
LOW SKEW, 1-TO-11 DIFFERENTIAL-TO-3.3V LVPECL
CLOCK MULTIPLIER / ZERO DELAY BUFFER
FIGURE 3C.
REF_CLK/nREF_CLK INPUT
DRIVEN BY 3.3V LVPECL DRIVER
FIGURE 3B. REF_CLK/nREF_CLK INPUT
DRIVEN BY 3.3V LVPECL DRIVER
FIGURE 3D. REF_CLK/nREF_CLK INPUT
DRIVEN BY 3.3V LVDS DRIVER
3.3V
R1
50
R3
50
Zo = 50 Ohm
LVPECL
Zo = 50 Ohm
HiPerClockS
CLK
nCLK
3.3V
Input
R2
50
Zo = 50 Ohm
Input
HiPerClockS
CLK
nCLK
3.3V
R3
125
R2
84
Zo = 50 Ohm
3.3V
R4
125
LVPECL
R1
84
3.3V
DIFFERENTIAL CLOCK INPUT INTERFACE
The REF_CLK /nREF_CLK accepts LVDS, LVPECL,
LVHSTL, SSTL, HCSL and other differential signals.
Both V
SWING and VOH must meet the VPP and VCMR input
requirements. Figures 3A to 3D show interface examples
for the REF_CLK/nREF_CLK input driven by the most com-
mon driver types. The input interfaces suggested here are
FIGURE 3A. REF_CLK/nREF_CLK INPUT
DRIVEN BY LVHSTL DRIVER
examples only. Please consult with the vendor of the driver
component to confirm the driver termination requirements.
For example in Figure 3A, the input termination applies for
LVHSTL drivers. If you are using an LVHSTL driver from
another vendor, use their termination recommendation.
1.8V
R2
50
Input
LVHSTL Driver
ICS
HiPerClockS
R1
50
LVHSTL
3.3V
Zo = 50 Ohm
HiPerClockS
CLK
nCLK
Zo = 50 Ohm
R1
100
3.3V
LVDS_Driv er
Zo = 50 Ohm
Receiv er
CLK
nCLK
3.3V
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PDF描述 |
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