参数资料
型号: ICS873996AYLFT
元件分类: 时钟及定时
英文描述: 873996 SERIES, PLL BASED CLOCK DRIVER, 6 TRUE OUTPUT(S), 0 INVERTED OUTPUT(S), PQFP48
封装: 7 X 7 MM, 1 MM HEIGHT, ROHS COMPLIANT, MS-026, TQFP-48
文件页数: 3/18页
文件大小: 246K
代理商: ICS873996AYLFT
873996AY
www.icst.com/products/hiperclocks.html
REV. A DECEMBER 22, 2004
11
Integrated
Circuit
Systems, Inc.
ICS873996
DIFFERENTIAL-TO-3.3V LVPECL
ZERO DELAY/MULTIPLIER/DIVIDER
PRELIMINARY
FIGURE 3C. HIPERCLOCKS CLK/NCLK INPUT DRIVEN BY
3.3V LVPECL DRIVER
FIGURE 3B. HIPERCLOCKS CLK/NCLK INPUT DRIVEN BY
3.3V LVPECL DRIVER
FIGURE 3D. HIPERCLOCKS CLK/NCLK INPUT DRIVEN BY
3.3V LVDS DRIVER
3.3V
R1
50
R3
50
Zo = 50 Ohm
LVPECL
Zo = 50 Ohm
HiPerClockS
CLK
nCLK
3.3V
Input
R2
50
Zo = 50 Ohm
Input
HiPerClockS
CLK
nCLK
3.3V
R3
125
R2
84
Zo = 50 Ohm
3.3V
R4
125
LVPECL
R1
84
3.3V
DIFFERENTIAL CLOCK INPUT INTERFACE
The CLKx /nCLKx accepts LVDS, LVPECL, LVHSTL, SSTL,
HCSL and other differential signals. Both V
SWING and VOH
must meet the V
PP and VCMR input requirements. Figures 3A
to 3D show interface examples for the HiPerClockS CLKx/
nCLKx input driven by the most common driver types. The
input interfaces suggested here are examples only. Please
FIGURE 3A. HIPERCLOCKS CLK/NCLK INPUT DRIVEN BY
ICS HIPERCLOCKS LVHSTL DRIVER
consult with the vendor of the driver component to confirm
the driver termination requirements. For example in Figure
3A, the input termination applies for ICS HiPerClockS
LVHSTL drivers. If you are using an LVHSTL driver from
another vendor, use their termination recommendation.
1.8V
R2
50
Input
LVHSTL Driver
ICS
HiPerClockS
R1
50
LVHSTL
3.3V
Zo = 50 Ohm
HiPerClockS
CLK
nCLK
Zo = 50 Ohm
R1
100
3.3V
LVDS_Driv er
Zo = 50 Ohm
Receiv er
CLK
nCLK
3.3V
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