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参数资料
型号： ICS87974CYILFT
厂商： IDT, Integrated Device Technology Inc
文件页数： 2/16页
文件大小： 0K
描述： IC CLOCK GEN 1-15 PLL 52-LQFP
标准包装： 500
系列： HiPerClockS™
类型： 时钟发生器
PLL： 带旁路
输入： LVCMOS，LVTTL
输出： LVCMOS，LVTTL
电路数： 1
比率 - 输入:输出： 2:14
差分 - 输入:输出： 无/无
频率 - 最大： 125MHz
除法器/乘法器： 是/无
电源电压： 3.135 V ~ 3.465 V
工作温度： -40°C ~ 85°C
安装类型： 表面贴装
封装/外壳： 52-LQFP
供应商设备封装： 52-TQFP（10x10）
包装： 带卷 (TR)
其它名称： 87974CYILFT
87974CYI
www.idt.com
REV. E JULY 26, 2010
10
ICS87974I
LOW SKEW, 1-TO-15,
LVCMOS/LVTTL CLOCK GENERATOR
FIGURE 2A. ICS87974I LVCMOS/LVTTL ZERO DELAY BUFFER SCHEMATIC EXAMPLE
LAYOUT GUIDELINE
The schematic of the ICS87974I layout example used in this
layout guideline is shown in
Figure 2A. The ICS87974I rec-
ommended PCB board layout for this example is shown in
Figure 2B. This layout example is used as a general guide-
line. The layout in the actual system will depend on the se-
lected component types, the density of the components, the
density of the traces, and the stack up of the P.C. board.
Q1
3.3V LVCMOS Driver
Zo = 50 Ohm
RS
C13
0.01u
3.3V
VDDO
(U1-49)
(U1-45)
(U1-41)
C12
0.1uF
C9
0.1uF
C10
0.1uF
nMR
Reset
pulse or
pull up
(U1-28)
(U1-17)
(U1-33)
(U1-22)
(U1-37)
(U1-26)
VDD
CLK_EN
PLL_SEL
SELA
SELB
SELC
CLK_SEL
RU6
SP
RD6
1K
RU5
SP
RD2
SP
RD4
1K
RU4
SP
RD5
1K
RU7
SP
RD3
SP
RU3
1K
RD7
1K
RU2
1K
C8
0.1uF
R7
10
C6
0.1uF
C7
0.1uF
C16
10u
C5
0.1uF
C4
0.1uF
C11
0.01u
SP = Space (i.e. not intstalled)
C3
0.1uF
VDD
U3
87974
GND
1
nMR
2
CLK_EN
3
SELB
4
SELC
5
PLL_SEL
6
SELA
7
CLK_SEL
8
CLK0
9
CLK1
10
nc
11
VDD
12
VDDA
13
FB_
SEL
0
14
GND
15
QA
4
16
V
DDOA
17
QA
3
18
GND
19
FB_
SEL
1
20
QA
2
21
V
DDOA
22
QA
1
23
GND
24
QA
0
25
V
DDOA
26
GND
39
QB1
38
VDDOB
37
QB2
36
GND
35
QB3
34
VDDOB
33
QB4
32
FB_IN
31
GND
30
QFB
29
VDDOFB
28
nc
27
VC
O
_
SEL
52
GND
51
QC0
50
V
DDOC
49
QC1
48
GND
47
QC2
46
V
DDOC
45
QC3
44
GND
43
nc
42
V
DDOB
41
QB
0
40
VDDO
R5
43
Zo = 50
Receiver
R8
43
Receiver
R1
43
Receiver
Zo = 50
R3
43
CLK_SEL
CLK_EN
SELB
SELC
VDD
PLL_SEL
SELA
VC
O
_
SEL
Example of Reconfigurable Logic Control Input
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