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参数资料
| 型号： | ICS91718YGLF-T |
| 厂商： | INTEGRATED DEVICE TECHNOLOGY INC |
| 元件分类： | 时钟及定时 |
| 英文描述： | PLL BASED CLOCK DRIVER, 2 TRUE OUTPUT(S), 0 INVERTED OUTPUT(S), PDSO8 |
| 封装： | 4.40 MM, 0.65 MM PITCH, LEAD FREE, MO-153, TSSOP-8 |
| 文件页数： | 8/11页 |
| 文件大小： | 84K |
| 代理商： | ICS91718YGLF-T |
6
ICS91718
0500D—07/15/04
BYTE
3 Pin #
Name
Control Function
0
1
PWD
Bit 7
X
RESERVED
RW Disable Enable
1
Bit 6
X
RESERVED
RW Disable Enable
1
Bit 5
X
RESERVED
RW Freerun
Not
Freerun
1
Bit 4
X
RESERVED
RW Freerun
Not
Freerun
1
Bit 3
x
RESERVED
RW Freerun
Not
Freerun
1
Bit 2
X
RESERVED
RW Disable Enable
1
Bit 1
X
RESERVED
RW Disable Enable
1
Bit 0
X
RESERVED
RW Disable Enable
1
BYTE
4 Pin #
Name
Control Function
0
1
PWD
Bit 7
X
RESERVED
RW Disable Enable
1
Bit 6
X
RESERVED
RW Disable Enable
1
Bit 5
X
RESERVED
RW Disable Enable
1
Bit 4
X
RESERVED
RW Disable Enable
1
Bit 3
X
RESERVED
RW Disable Enable
1
Bit 2
X
RESERVED
RW Disable Enable
1
Bit 1
X
RESERVED
RW Disable Enable
1
Bit 0
X
RESERVED
RW Disable Enable
1
BYTE
5 Pin #
Name
Control Function
0
1
PWD
Bit 7
X
RESERVED
-
1
Bit 6
X
RESERVED
-
1
Bit 5
X
RESERVED
-
1
Bit 4
X
RESERVED
-
1
Bit 3
X
RESERVED
RW Disable Enable
1
Bit 2
X
RESERVED
RW Disable Enable
1
Bit 1
X
RESERVED
RW Disable Enable
1
Bit 0
X
RESERVED
RW Disable Enable
1
Affected Pin
T
YPE
Bit Control
T
YPE
Bit Control
Affected Pin
Bit Control
T
YPE
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PDF描述 |
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