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参数资料
| 型号： | ICS9248BF-138 |
| 厂商： | IDT, Integrated Device Technology Inc |
| 文件页数： | 5/12页 |
| 文件大小： | 0K |
| 描述： | IC FREQ GENERATOR/BUFFER 48-SSOP |
| 标准包装： | 30 |
| 类型： | 时钟/频率发生器，扇出缓冲器（分配） |
| PLL： | 是 |
| 主要目的： | Intel CPU 服务器 |
| 输入： | 晶体 |
| 输出： | 时钟 |
| 电路数： | 1 |
| 比率 - 输入:输出： | 1:26 |
| 差分 - 输入:输出： | 无/无 |
| 频率 - 最大： | 200MHz |
| 电源电压： | 3.135 V ~ 3.465 V |
| 工作温度： | 0°C ~ 70°C |
| 安装类型： | 表面贴装 |
| 封装/外壳： | 48-BSSOP（0.295"，7.50mm 宽） |
| 供应商设备封装： | 48-SSOP |
| 包装： | 管件 |
| 其它名称： | 9248BF-138 |
2
ICS9248-138
0342C—08/26/03
General Description
Pin Configuration
The ICS9248-138 is the single chip clock solution for designs using the 810/810E and Solano style chipset. It provides
all necessary clock signals for such a system.
Spread spectrum may be enabled through I
2C programming. Spread spectrum typically reduces system EMI by 8dB to
10dB. This simplifies EMI qualification without resorting to board design iterations or costly shielding. The ICS9248-138
employs a proprietary closed loop design, which tightly controls the percentage of spreading over process and
temperature variations.
Serial programming I
2C interface allows changing functions, stop clock programming and frequency selection.
PIN NUMBER
PIN NAME
TYPE
DESCRIPTION
SEL24_48MHz#
IN
Logic inputs frequency select I/O/USB output,
When a "0" is latched, output frequency = 48MHz
When a "1" is latched, output frequency = 24MHz
REF0
OUT
14.318 MHz reference clock.
2, 10, 11, 18, 25,
30, 38
VDD
PWR
3.3V Power supply for SDRAM output buffers, PCI output buffers, reference
output buffers and 48MHz output
3
X1
IN
Crystal input,nominally 14.318MHz.
4
X2
OUT
Crystal output, nominally 14.318MHz.
5, 6, 14, 21, 29, 34,
42
GND
PWR
Ground pin for 3V outputs.
9, 8, 7
3V66 [2:0]
OUT
3.3V Clocks
FS0
IN
Frequency select pin.
PCICLK0
OUT
PCI clock output
FS1
IN
Frequency select pin.
PCICLK1
OUT
PCI clock output
20, 19, 17, 16, 15
PCICLK [6:2]
OUT
PCI clock outputs.
22
PD#
IN
Asynchronous active low input pin used to power down the device into a low
power state. The internal clocks are disabled and the VCO and the crystal are
stopped. The latency of the power down will not be greater than 3ms.
23
SCLK
IN
Clock input of I2C input, 5V tolerant input
24
SDATA
IN
Data input for I2C serial input, 5V tolerant input
FS4
IN
Frequency select pin.
48MHz
OUT
48MHz output clocks
FS3
IN
Frequency select pin.
48MHz
OUT
48MHz output clocks
FS2
IN
Frequency select pin.
24_48MHz
OUT
24 or 48MHz output
31
SDRAM_F
OUT
Free running SDRAM - used for feed back to chipset, should remain on always.
32, 33, 35, 36, 37,
39, 40, 41,
SDRAM [7:0]
OUT
SDRAM clock outputs
43
GNDLCPU
PWR
Ground pin for the CPU clocks.
44, 45
CPUCLK [1:0]
OUT
CPU clock outputs.
46
VDDLCPU
PWR
Power pin for the CPUCLKs. 2.5V
47
IOAPIC
OUT
2.5V clock output
48
VDDLAPIC
PWR
Power pin for the IOAPIC. 2.5V
1
26
28
12
13
27
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