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参数资料
| 型号： | ICS9248BF-138LFT |
| 厂商： | IDT, Integrated Device Technology Inc |
| 文件页数： | 7/12页 |
| 文件大小： | 0K |
| 描述： | IC FREQ GENERATOR/BUFFER 48-SSOP |
| 产品变化通告： | Product Discontinuation 4/Aug/2011 |
| 标准包装： | 1,000 |
| 类型： | 时钟/频率发生器，扇出缓冲器（分配） |
| PLL： | 是 |
| 主要目的： | Intel CPU 服务器 |
| 输入： | 晶体 |
| 输出： | 时钟 |
| 电路数： | 1 |
| 比率 - 输入:输出： | 1:26 |
| 差分 - 输入:输出： | 无/无 |
| 频率 - 最大： | 200MHz |
| 电源电压： | 3.135 V ~ 3.465 V |
| 工作温度： | 0°C ~ 70°C |
| 安装类型： | 表面贴装 |
| 封装/外壳： | 48-BSSOP（0.295"，7.50mm 宽） |
| 供应商设备封装： | 48-SSOP |
| 包装： | 带卷 (TR) |
| 其它名称： | 9248BF-138LFT |
4
ICS9248-138
0342C—08/26/03
Byte 1: SDRAM Control Register
(1= enable, 0 = disable)
T
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Byte 4: Control Register
(1= enable, 0 = disable)
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Byte 3: 3V66, Control Register
(1= enable, 0 = disable)
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3
Byte 2: PCI, Control Register
(1= enable, 0 = disable)
T
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C
P
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t
i
B2
11
0
K
L
C
I
C
P
Notes:
1. Inactive means outputs are held LOW and are disabled
from switching.
2. Latched Frequency Selects (FS#) will be inverted
logic load of the input frequency select pin conditions.
Byte 5: Control Register
(1= enable, 0 = disable)
T
I
B#
N
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PD
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)
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R
Byte 6: Control Register
(1= enable, 0 = disable)
Note: Don’t write into this register, writing into this
register can cause malfunction.This Byte
becomes the Byte Count for Readback, so it
cannot be seen as data.
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PDF描述 |
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