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参数资料
型号： ICS9250BF-12
厂商： IDT, Integrated Device Technology Inc
文件页数： 6/12页
文件大小： 0K
描述： IC FREQ TIMING GENERATOR 56-SSOP
标准包装： 26
类型： 时钟/频率合成器
PLL： 是
主要目的： Intel CPU 服务器
输入： 晶体
输出： 时钟
电路数： 1
比率 - 输入:输出： 1:24
差分 - 输入:输出： 无/无
频率 - 最大： 133MHz
电源电压： 3.135 V ~ 3.465 V
工作温度： 0°C ~ 70°C
安装类型： 表面贴装
封装/外壳： 56-BSSOP（0.295"，7.50mm 宽）
供应商设备封装： 56-SSOP
包装： 管件
其它名称： 9250BF-12
3
ICS9250-12
Frequency Select:
Note:
1. TCLK is a test clock driven on the x1 input during test mode.
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ICS9250-12 Power Management Features:
Note:
1. LOW means outputs held static LOW as per latency requirement next page.
2. On means active.
3. PD# pulled Low, impacts all outputs including REF and 48 MHz outputs.
4.All 3V66 as well as all CPLU clocks should stop cleanly when CPU_STOP# is pulled LOW.
5. CPU/2, IOAPIC, REF, 48 MHz signals are not controlled by the CPU_STOP# functionality and are enabled all in all conditions
except PD# = LOW
Power Groups:
VDDREF,GNDREF=REF,X1,X2
GNDPCI,VDDPCI=PCICLK
VDD66,GND66=3V66
VDD48,GND48=48MHz
VDDCOR,GNDCOR=PLLCore
VDDLCPU/2,GNDLCPU/2=CPU/2
VDDLIOAPIC,GNDIOAPIC=IOAPIC
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PDF描述
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