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参数资料
| 型号： | ICS950202YFLFT |
| 厂商： | INTEGRATED DEVICE TECHNOLOGY INC |
| 元件分类： | 时钟产生/分配 |
| 英文描述： | 200 MHz, PROC SPECIFIC CLOCK GENERATOR, PDSO48 |
| 封装： | 0.300 INCH, ROHS COMPLIANT, MO-118, SSOP-48 |
| 文件页数： | 17/20页 |
| 文件大小： | 223K |
| 代理商： | ICS950202YFLFT |
6
Integrated
Circuit
Systems, Inc.
ICS950202
0461M—02/10/06
Byte 1: Output Control Register
(1 = enable, 0 = disable)
Byte 3: Output Control Register
(1 = enable, 0 = disable)
Byte 2: Output Control Register
(1 = enable, 0 = disable)
Byte 4: Output Control Register
(1 = enable, 0 = disable)
t
i
B#
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P
Notes:
1. PWD = Power on Default
2. For disabled clocks, they stop low for single ended clocks. Differential CPU clocks stop with CPUCLKT at
high, CPUCLKC off, and external resistor termination will bring CPUCLKC low.
Bit
Pin#
PWD
Description
Bit7
34
1
48MHZ_DOT
Bit6
35
1
48MHz_USB
Bit5
-
1
Reset gear shift detect 1 = Enable, 0 = Disable
Bit4
-
X
Reserved
Bit3
31
0
3V66_0/VCH_CLK, (default) = 66.66MHz, 1=48MHz
Bit2
-
X
Reserved
Bit1
6
1
PCICLK8
Bit0
5
1
PCICLK7
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PDF描述 |
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