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参数资料
| 型号： | ICS951402AF |
| 厂商： | IDT, Integrated Device Technology Inc |
| 文件页数： | 23/23页 |
| 文件大小： | 0K |
| 描述： | IC TIMING CTRL HUB P4 48-SSOP |
| 标准包装： | 30 |
| 系列： | TCH™ |
| 类型： | 时钟/频率发生器，多路复用器 |
| PLL： | 是 |
| 主要目的： | Intel CPU，Timing Control Hub? |
| 输入： | 晶体 |
| 输出： | 时钟 |
| 电路数： | 1 |
| 比率 - 输入:输出： | 1:19 |
| 差分 - 输入:输出： | 无/是 |
| 频率 - 最大： | 210MHz |
| 电源电压： | 3.135 V ~ 3.465 V |
| 工作温度： | 0°C ~ 70°C |
| 安装类型： | 表面贴装 |
| 封装/外壳： | 48-BSSOP（0.295"，7.50mm 宽） |
| 供应商设备封装： | 48-SSOP |
| 包装： | 管件 |
| 其它名称： | 951402AF |
9
Integrated
Circuit
Systems, Inc.
ICS951402
Advance Information
0660—05/05/05
I
2C Table: Watchdog Timer Register
Byte 9
Pin #
Name
Control Function Type
0
1
PWD
Bit 7
-
WD7
RW
-
0
Bit 6
-
WD6
RW
-
0
Bit 5
-
WD5
RW
-
0
Bit 4
-
WD4
RW
-
1
Bit 3
-
WD3
RW
-
0
Bit 2
-
WD2
RW
-
0
Bit 1
-
WD1
RW
-
0
Bit 0
-
WD0
These bits represent
X*293ms the
watchdog timer will
wait before it goes to
alarm mode. Default
is 16 X 293ms =4.688
seconds
RW
-
0
I
2C Table: WD Timer Control Register
Byte 10 Pin #
Name
Control
Function
Type
0
1
PWD
Bit 7
-
M/NEN
M/N Programming
Enable
RW
Latched
Inputs
IIC Prog.
B (11:17)
0
Bit 6
-
WDEN
Watchdog Enable
RW
Disable
Enable
0
Bit 5
-
WDStatus
WD Status Control
RW
OFF
ON
0
Bit 4
-
WD SF4
RW
-
1
Bit 3
-
WD SF3
RW
-
0
Bit 2
-
WD SF2
RW
-
0
Bit 1
-
WD SF1
RW
-
0
Bit 0
-
WD SF0
Writing to these bit will
configure the safe
frequency as Byte 0 Bit
(6:0
)
RW
-
0
Note: If Byte4 bit1 = 0 then FS4=0
I
2C Table: VCO Frequency Control Register
Byte 11 Pin #
Name
Control
Function
Type
0
1
PWD
Bit 7
-
N Div8
N Divider Bit 8
RW
-
X
Bit 6
-
M Div6
RW
-
X
Bit 5
-
M Div5
RW
-
X
Bit 4
-
M Div4
RW
-
X
Bit 3
-
M Div3
RW
-
X
Bit 2
-
M Div2
RW
-
X
Bit 1
-
M Div1
RW
-
X
Bit 0
-
M Div0
The decimal
representation of M
Div (6:0) is equal to
reference divider
value. Default at
power up = latch-in
or Byte 0 Rom table.
RW
-
X
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