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参数资料
| 型号： | ICS951412YGT |
| 厂商： | INTEGRATED DEVICE TECHNOLOGY INC |
| 元件分类： | 时钟产生/分配 |
| 英文描述： | 220 MHz, PROC SPECIFIC CLOCK GENERATOR, PDSO56 |
| 封装： | 6.10 MM, 0.50 MM PITCH, MO-153, TSSOP-56 |
| 文件页数： | 16/21页 |
| 文件大小： | 188K |
| 代理商： | ICS951412YGT |
4
ICS951412
0883L—04/26/06
General Description
The ICS951412 is a main clock synthesizer chip that provides all clocks required for ATI RS480-based systems.
An SMBus interface allows full control of the device.
Skew Characteristics
Parameter
Description
Test Conditons
Skew
Window
Unit
Tsk_CPU_CPU
measured at x-ing of CPU,
250
ps
Tsk_CPU_PCI
measured at x-ing of CPU,
1.5V of PCI clock
2000
ps
Tsk_PCI_PCI
measured between rising
edge at 1.5V
500
ps
Tsk_PCI33-HT66
measured between rising
edge at 1.5V
500
ps
Tsk_CPU_HT66
measured between rising
edge at 1.5V
2000
ps
Tsk_CPU_HT66
measured at x-ing of CPU,
1.5V of PCI clock
500
ps
Tsk_CPU_CPU
measured at x-ing of CPU,
200
ps
Tsk_CPU_PCI
measured at x-ing of CPU,
1.5V of PCI clock
200
ps
Tsk_PCI_PCI
measured between rising
edge at 1.5V
200
ps
Tsk_PCI33-HT66
measured between rising
edge at 1.5V
200
ps
Tsk_CPU_HT66
measured between rising
edge at 1.5V
200
ps
Tsk_CPU_HT66
measured at x-ing of CPU,
1.5V of PCI clock
200
ps
time independent
skew
not dependent on
V, T changes
time variant skew
varies over
V, T changes
Block Diagram
MAIN PLL
PCICLK0
CONTROL
LOGIC
XTAL
OSC.
CPUCLK8(1:0)
FIXED PLL
USB_48MHz
DIVIDER
DIVIDERS
REF(2:0)
HTTCLK0
SRCCLK(7:3,0)
CLKREQA#
SDATA
SCLK
FS(2:0)
CLKREQB#
SEL75#/100
X1
X2
IREF
ATIGCLK(1:0)
相关PDF资料 |
PDF描述 |
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相关代理商/技术参数 |
参数描述 |
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