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参数资料
型号： ICS97U870AKT
厂商： IDT, Integrated Device Technology Inc
文件页数： 10/13页
文件大小： 0K
描述： IC CLK DVR PLL 1:10 40VFQFN
产品变化通告： Product Discontinuation 09/Dec/2011
标准包装： 1,000
类型： 驱动器，PLL
PLL： 带旁路
输入： 时钟
输出： SSTL-18
电路数： 1
比率 - 输入:输出： 1:10
差分 - 输入:输出： 是/是
频率 - 最大： 370MHz
除法器/乘法器： 无/无
电源电压： 1.7 V ~ 1.9 V
工作温度： 0°C ~ 70°C
安装类型： 表面贴装
封装/外壳： 40-VFQFN 裸露焊盘
供应商设备封装： 40-VFQFPN（6x6）
包装： 带卷 (TR)
其它名称： 97U870AKT
6
ICS97U870
Advance Information
0817—07/07/03
Notes:
1.
Switching characteristics guaranteed for application frequency range.
2.
Static phase offset shifted by design.
Timing Requirements
TA = 0 - 70°C Supply Voltage AVDD, VDDQ = 1.8 V +/- 0.1V (unless otherwise stated)
PARAMETER
SYMBOL
CONDITIONS
MIN
MAX
UNITS
Max clock frequency
freqop
1.8V+0.1V @ 25°C
95
370
MHz
Application Frequency
Range
freqApp
1.8V+0.1V @ 25°C
160
350
MHz
Input clock duty cycle
dtin
40
60
%
CLK stabilization
TSTAB
15
s
Switching Characteristics
1
TA = 0 - 70°C Supply Voltage AVDD, VDDQ = 1.8 V +/- 0.1V (unless otherwise stated)
PARAMETER
SYMBOL
CONDITION
MIN
TYP
MAX
UNITS
Output enable time
ten
OE to any output
4.73
8
ns
Output disable time
tdis
OE to any output
5.82
8
ns
Period jitter
tjit (per)
-30
30
ps
Half-period jitter
tjit(hper)
-60
60
ps
Input Clock
1
2.5
4
v/ns
Output Enable (OE), (OS)
0.5
v/ns
Output clock slew rate
SLr1(o)
1.5
2.5
3
v/ns
tjit(cc+)
040
ps
tjit(cc-)
0
-40
ps
Dynamic Phase Offset
t( )dyn
-20
20
ps
Static Phase Offset
tSPO
2
-50
0
50
ps
Output to Output Skew
tskew
40
ps
SSC modulation frequency
30.00
33
kHz
SSC clock input frequency
deviation
0.00
-0.50
%
PLL Loop bandwidth (-3 dB
from unity gain)
2.0
MHz
Cycle-to-cycle period jitter
Input slew rate
SLr1(i)
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PDF描述
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