参数资料
型号: ICS98UAE877AHLFT
厂商: IDT, Integrated Device Technology Inc
文件页数: 16/16页
文件大小: 0K
描述: IC CLOCK DRIVER 1.8V LP 52-BGA
产品变化通告: Product Discontinuation 09/Dec/2011
标准包装: 2,500
类型: 时钟缓冲器/驱动器,零延迟缓冲器,多路复用器
PLL:
主要目的: 存储器,DDR2
输入: 时钟
输出: 时钟
电路数: 1
比率 - 输入:输出: 1:10
差分 - 输入:输出: 是/是
频率 - 最大: 410MHz
电源电压: 1.425 V ~ 1.575 V
工作温度: 0°C ~ 70°C
安装类型: 表面贴装
封装/外壳: 52-VFBGA
供应商设备封装: 52-CABGA(4.5x7.0)
包装: 带卷 (TR)
其它名称: 98UAE877AHLFT
ICS98UAE877A
1.5V LOW-POWER WIDE-RANGE FREQUENCY CLOCK DRIVER
COMMERCIAL TEMPERATURE GRADE
1.5V LOW-POWER WIDE-RANGE FREQUENCY CLOCK DRIVER
9
ICS98UAE877A
7181/3
Switching Characteristics Over Recommended Free Air Operating Range
Following Conditions Apply Unless Otherwise Specified:
Commercial: TA = 0°C to +70°C, Industrial: TA = -40°C to +85°C; Supply Voltage AVDD/VDDQ = 1.5V ± 0.075V
Symbol
Parameter1
1
Guaranteed for application frequency range.
Conditions
(MHz)
Min.
Typ.
Max.
Units
tEN
Output Enable Time
OE to any output
160 - 410
4.73
8
ns
tDIS
Output Disable Time
OE to any output
5.82
8
ns
tJIT(PER)
Period Jitter
160 - 270
-40
40
ps
271 - 410
-30
30
tJIT(HPER)
Half-Period Jitter
160 - 270
-60
60
ps
271 - 410
-50
50
SL
r
1(i)
Input Slew Rate
Input Clock
160 - 410
12.5
4
v/ns
Output Enable
(OE, OS)
0.5
SL
r
1(o)
Output Clock Slew Rate
0.8
2
v/ns
tJIT(CC+)
Cycle-to-Cycle Period Jitter
040
ps
tJIT(CC-)
0-40
t
() DYN
Dynamic Phase Offset
160 - 270
-50
50
ps
271 - 410
-20
20
tSPO2
2
Static phase offset shifted by design.
Static Phase Offset
271 - 410
-60
0
60
ps
(su)
tJIT(PER) + t
() DYN + tSKEW(O)80
ps
t(h)
t
() DYN + tSKEW(O)60
ps
tSKEW
Output-to-Output Skew
160 - 270
60
ps
271 - 410
30
SSC Modulation Frequency
30
33
KHz
SSC Clock Input Frequency
Deviation
0-0.5
%
PLL Loop Bandwidth (-3dB
from unity gain)
2MHz
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