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参数资料
| 型号： | ICS9DB206CF |
| 元件分类： | 时钟及定时 |
| 英文描述： | 9DB SERIES, PLL BASED CLOCK DRIVER, 6 TRUE OUTPUT(S), 0 INVERTED OUTPUT(S), PDSO28 |
| 封装： | 5.30 X 10.20 MM, 1.75 MM HEIGHT, MO-150, SSOP-28 |
| 文件页数： | 13/13页 |
| 文件大小： | 247K |
| 代理商： | ICS9DB206CF |
9DB206CL
www.icst.com/products/hiperclocks.html
REV. B MARCH 21, 2005
9
Integrated
Circuit
Systems, Inc.
ICS9DB206
PCI EXPRESS
JITTER ATTENUATOR
SCHEMATIC EXAMPLE
The schematic below illustrates two different terminations. Both
are reliable and adequate. The PCI Express termination is rec-
ommended for all PCI Express application. The optional termi-
FIGURE 4. EXAMPLE OF ICS9DB206 SCHEMATIC
nation, which has a slightly better signal integrity, is recom-
mended for all other applications.
U1
ICS9DB206
1
2
3
4
5
6
7
8
9
10
11
12
13
14
15
16
17
18
19
20
21
22
23
24
28
27
26
25
PLL_BW
CLK
nCLK
FS0
PCIEXT0
PCIEXC0
VDD
GND
PCIEXT1
PCIEXC1
PCIEXT2
PCIEXC2
VDD
nOE0
nOE1
VDD
PCIEXC3
PCIEXT3
PCIEXC4
PCIEXT4
GND
VDD
PCIEXC5
PCIEXT5
VDDA
GNDA
IREF
FS1
(U1-7)
HCSL
R1
50
C1
0.1uF
R18
50
nOE0
(U1-16)
C3
0.1uF
VCC
VCC=3.3V
PCI Express Termination
should be as close the
device as possible
FS0
R19
33
Zo = 50
R3
33
R4
50
Zo = 50
VCC
R20
33
R14
1K
VCC
R11
1K
nOE1
PCI Express Termination
Zo = 50
VCCA
HCSL
+
-
Zo = 50
R6
33
C2
0.1uF
R5
50
R7
24
Zo = 50
R12
1K
HCSL
+
-
R13
1K
R15
1K
C16
10uF
R2
50
R17
50
R10
475
VCC
Optional Termination
(U1-22)
FS1
VCC
C11
0.1uF
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