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参数资料
| 型号： | ICS9DB401 |
| 英文描述： | Four Output Differential Buffer for PCI Express |
| 中文描述： | 四个输出差分缓冲器为PCI Express |
| 文件页数： | 3/16页 |
| 文件大小： | 175K |
| 代理商： | ICS9DB401 |
3
Integrated
Circuit
Systems, Inc.
ICS9DB401
1014B—09/07/06
PIN #
PIN NAME
PIN TYPE
DESCRIPTION
1
2
3
4
5
6
7
VDD
SRC_IN
SRC_IN#
GND
VDD
DIF_1
DIF_1#
PWR
IN
IN
PWR
PWR
OUT
OUT
Power supply, nominal 3.3V
0.7 V Differential SRC TRUE input
0.7 V Differential SRC COMPLEMENTARY input
Ground pin.
Power supply, nominal 3.3V
0.7V differential true clock output
0.7V differential complement clock output
Active low input for enabling DIF pair 1.
1 = tri-state outputs, 0 = enable outputs
0.7V differential true clock output
0.7V differential complement clock output
Power supply, nominal 3.3V
Input to select Bypass(fan-out) or PLL (ZDB) mode
0 = Bypass mode, 1= PLL mode
Clock pin of SMBus circuitry, 5V tolerant.
Data pin for SMBus circuitry, 5V tolerant.
Asynchronous active high input pin used to power down the device. The
internal clocks are disabled and the VCO is stopped.
Active high input to stop SRC outputs.
3.3V input for selecting PLL Band Width
0 = High, 1= Low
Power supply, nominal 3.3V
0.7V differential complement clock output
0.7V differential true clock output
Active low input for enabling DIF pair 6.
1 = tri-state outputs, 0 = enable outputs
0.7V differential complement clock output
0.7V differential true clock output
Power supply, nominal 3.3V
This latched input selects the polarity of the OE pins.
0 = OE pins active high, 1 = OE pins active low (OE#)
This pin establishes the reference current for the differential current-
mode output pairs. This pin requires a fixed precision resistor tied to
ground in order to establish the appropriate current. 475 ohms is the
standard value.
Ground pin for the PLL core.
3.3V power for the PLL core.
8
OE1#
IN
9
10
11
DIF_2
DIF_2#
VDD
OUT
OUT
PWR
12
BYPASS#/PLL
IN
13
14
SCLK
SDATA
IN
I/O
15
PD
IN
16
SRC_STOP
IN
17
HIGH_BW#
IN
18
19
20
VDD
DIF_5#
DIF_5
PWR
OUT
OUT
21
OE6#
IN
22
23
24
DIF_6#
DIF_6
VDD
OUT
OUT
PWR
25
OE_INV
IN
26
IREF
OUT
27
28
GNDA
VDDA
PWR
PWR
Pin Decription When OE_INV = 1
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PDF描述 |
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