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参数资料
| 型号： | ICS9FG104YGLFT |
| 元件分类： | 时钟产生/分配 |
| 英文描述： | 400 MHz, PROC SPECIFIC CLOCK GENERATOR, PDSO28 |
| 封装： | 4.40 MM, 0.65 MM PITCH, ROHS COMPLIANT, MO-153, TSSOP-28 |
| 文件页数： | 8/15页 |
| 文件大小： | 160K |
| 代理商： | ICS9FG104YGLFT |
2
Integrated
Circuit
Systems, Inc.
ICS9FG104
0839G—06/05/06
Pin Description
PIN
#
PIN NAME
PIN TYPE
DESCRIPTION
1
XIN/CLKIN
IN
Crystal input or Reference Clock input
2
X2
OUT
Crystal output, Nominally 14.318MHz
3
VDD
PWR
Power supply, nominal 3.3V
4
GND
IN
Ground pin.
5
REFOUT
OUT
Reference Clock output
6
FS2
IN
Frequency select pin.
7
DIF_3
OUT
0.7V differential true clock outputs
8
DIF_3#
OUT
0.7V differential complement clock outputs
9
VDD
PWR
Power supply, nominal 3.3V
10
GND
PWR
Ground pin.
11
DIF_2
OUT
0.7V differential true clock outputs
12
DIF_2#
OUT
0.7V differential complement clock outputs
13
SDATA
I/O
Data pin for SMBus circuitry, 5V tolerant.
14
SCLK
IN
Clock pin of SMBus circuitry, 5V tolerant.
15
DIF_STOP#
IN
Active low input to stop differential output clocks.
16
SPREAD
IN
Asynchronous, active high input, with internal 120Kohm pull-up
resistor, to enable spread spectrum functionality.
17
SEL14M_25M#
IN
Select 14.31818 MHz or 25 Mhz input frequency. 1 = 14.31818
MHz, 0 = 25 MHz
18
DIF_1#
OUT
0.7V differential complement clock outputs
19
DIF_1
OUT
0.7V differential true clock outputs
20
GND
PWR
Ground pin.
21
VDD
PWR
Power supply, nominal 3.3V
22
DIF_0#
OUT
0.7V differential complement clock outputs
23
DIF_0
OUT
0.7V differential true clock outputs
24
FS1
IN
Frequency select pin.
25
FS0
IN
Frequency select pin.
26
IREF
OUT
This pin establishes the reference current for the differential current-
mode output pairs. This pin requires a fixed precision resistor tied
to ground in order to establish the appropriate current. 475 ohms is
the standard value.
27
GNDA
PWR
Ground pin for the PLL core.
28
VDDA
PWR
3.3V power for the PLL core.
相关PDF资料 |
PDF描述 |
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