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参数资料
| 型号： | ICS9FG108YGLF-T |
| 厂商： | INTEGRATED DEVICE TECHNOLOGY INC |
| 元件分类： | XO, clock |
| 英文描述： | Frequency Generator for CPU, QPI, FBD, PCIe Gen 2 & SATA |
| 中文描述： | 400 MHz, PROC SPECIFIC CLOCK GENERATOR, PDSO48 |
| 封装： | 6.10 MM WIDTH, 0.50 MM PITCH, ROHS COMPLIANT, MO-153, TSSOP-48 |
| 文件页数： | 8/19页 |
| 文件大小： | 263K |
| 代理商： | ICS9FG108YGLF-T |
IDT
TM
/ICS
TM
Frequency Generator for CPU, QPI, FBD, PCIe Gen 2 & SATA
ICS9FG108 REV G 04/06/07
ICS9FG108
Frequency Generator for CPU, QPI, FBD, PCIe Gen 2 & SATA
8
SMBus Table: Byte Count Register
Pin #
Bit 7
Bit 6
Bit 5
Bit 4
Bit 3
Bit 2
Bit 1
Bit 0
-
Name
BC7
BC6
BC5
BC4
BC3
BC2
BC1
BC0
Control Function
Type
RW
RW
RW
RW
RW
RW
RW
RW
0
-
-
-
-
-
-
-
-
1
-
-
-
-
-
-
-
-
PWD
0
0
0
0
0
1
1
1
SMBus Table: Reserved Register
Pin #
Bit 7
Bit 6
Bit 5
Bit 4
Bit 3
Bit 2
Bit 1
Bit 0
Name
Control Function
Type
0
1
PWD
X
X
X
X
X
X
X
X
SMBus Table: Reserved Register
Pin #
Bit 7
Bit 6
Bit 5
Bit 4
Bit 3
Bit 2
Bit 1
Bit 0
Name
Control Function
Type
0
1
PWD
X
X
X
X
X
X
X
X
SMBus Table: M/N Programming Enable
Pin #
Byte 9
Name
Control Function
PLL M/N Programming
Enable
Select Polarity of OE inputs
Enables/Disables REF
Type
0
1
PWD
Bit 7
M/N_EN
RW
Disable
Enable
0
Bit 6
Bit 5
Bit 4
Bit 3
Bit 2
Bit 1
Bit 0
OE_Polarity
REFOUT_En
RW
RW
OE#
Disable
OE
1
1
0
0
0
0
0
Enable
Byte 6
Writing to this register will
configure how many bytes
will be read back, default is
07
= 7 bytes.
-
-
-
-
-
-
-
5
Reserved
Reserved
Reserved
Reserved
Reserved
-
-
Byte 7
Reserved
Reserved
Reserved
Reserved
Reserved
Reserved
Byte 8
Reserved
Reserved
Reserved
Reserved
Reserved
Reserved
Reserved
Reserved
Reserved
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