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参数资料
| 型号： | IDT2309B-1HPGG |
| 厂商： | IDT, Integrated Device Technology Inc |
| 文件页数： | 9/10页 |
| 文件大小： | 0K |
| 描述： | IC CLK BUFFER HIGH DRIVE 16TSSOP |
| 产品培训模块： | Clock Distibution and Generation 1.0 |
| 标准包装： | 96 |
| 类型： | 零延迟缓冲器 |
| PLL： | 带旁路 |
| 输入： | LVTTL |
| 输出： | LVTTL |
| 电路数： | 1 |
| 比率 - 输入:输出： | 1:9 |
| 差分 - 输入:输出： | 无/无 |
| 频率 - 最大： | 133MHz |
| 除法器/乘法器： | 无/无 |
| 电源电压： | 3 V ~ 3.6 V |
| 工作温度： | 0°C ~ 70°C |
| 安装类型： | 表面贴装 |
| 封装/外壳： | 16-TSSOP（0.173"，4.40mm 宽） |
| 供应商设备封装： | 16-TSSOP |
| 包装： | 管件 |
| 其它名称： | 2309B-1HPGG 800-1303 800-1303-5 800-1303-ND |
8
COMMERCIALANDINDUSTRIALTEMPERATURERANGES
IDT2309B
3.3VZERODELAYCLOCKBUFFER
TYPICALDUTY CYCLE(1)AND IDD TRENDS(2)FOR IDT2309B-1
NOTES:
1. Duty Cycle is taken from typical chip measured at 1.4V.
2. IDD data is calculated from IDD = ICORE + nCVf, where ICORE is the unloaded current. (n = Number of outputs; C = Capacitance load per output (F);
V = Supply Voltage (V); f = Frequency (Hz))
3
3.1
3.2
3.3
3.4
3.5
3.6
VDD (V)
40
42
44
46
48
50
52
54
56
58
60
Duty Cycle vs VDD
(for 30pf loads over frequency - 3.3V, 25C)
33MHz
66MHz
100MHz
D
u
ty
C
y
c
le
(%
)
3
3.1
3.2
3.3
3.4
3.5
3.6
VDD (V)
40
42
44
46
48
50
52
54
56
58
60
Duty Cycle vs VDD
(for 10pF loads over frequency - 3.3V, 25C)
33MHz
66MHz
100MHz
20
40
60
80
100
120
140
Frequency (MHz)
40
42
44
46
48
50
52
54
56
58
60
Duty Cycle vs Frequency
(for 30pf loads over temperature - 3.3V)
-40C
0C
25C
70C
85C
D
u
ty
C
y
c
le
(%
)
D
u
ty
C
y
c
le
(%
)
133MHz
20
40
60
80
100
120
140
Frequency (MHz)
40
42
44
46
48
50
52
54
56
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60
Duty Cycle vs Frequency
(for 10pF loads over temperature - 3.3V)
-40C
0C
25C
70C
85C
D
u
ty
C
y
c
le
(%
)
02
4
6
8
Number of Loaded Outputs
0
20
40
60
80
100
120
140
IDD vs Number of Loaded Outputs
(for 30pf loads over frequency - 3.3V, 25C)
33MHz
66MHz
100MHz
ID
D
(m
A
)
02
4
6
8
Number of Loaded Outputs
0
20
40
60
80
100
120
140
IDD vs Number of Loaded Outputs
(for 10pF loads over frequency - 3.3V, 25C)
33MHz
66MHz
100MHz
ID
D
(m
A
)
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PDF描述 |
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