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参数资料
| 型号： | IDT23S05-1DCG |
| 厂商： | IDT, Integrated Device Technology Inc |
| 文件页数： | 6/9页 |
| 文件大小： | 0K |
| 描述： | IC CLK BUFFER PLL STD DRV 8-SOIC |
| 标准包装： | 97 |
| 类型： | 零延迟缓冲器 |
| PLL： | 带旁路 |
| 输入： | LVTTL |
| 输出： | LVTTL |
| 电路数： | 1 |
| 比率 - 输入:输出： | 1:5 |
| 差分 - 输入:输出： | 无/无 |
| 频率 - 最大： | 133MHz |
| 除法器/乘法器： | 无/无 |
| 电源电压： | 3 V ~ 3.6 V |
| 工作温度： | 0°C ~ 70°C |
| 安装类型： | 表面贴装 |
| 封装/外壳： | 8-SOIC（0.154"，3.90mm 宽） |
| 供应商设备封装： | 8-SOIC |
| 包装： | 管件 |
| 其它名称： | 23S05-1DCG |
6
COMMERCIALANDINDUSTRIALTEMPERATURERANGES
IDT23S05
3.3VZERODELAYCLOCKBUFFER,SPREADSPECTRUM
ZERO DELAY AND SKEW CONTROL
All outputs should be uniformly loaded in order to achieve Zero I/O Delay. Since the CLKOUT pin is the internal feedback for the PLL, its relative
loading can affect and adjust the input/output delay.
For designs utilizing zero I/O Delay, all outputs including CLKOUT must be equally loaded. Even if the output is not used, it must have a capacitive
load equal to that on the other outputs in order to obtain true zero I/O Delay. If I/O Delay adjustments are needed, use the Output Load Difference diagram
to calculate loading differences between the CLKOUT pin and other outputs. For zero output-to-output skew, all outputs must be loaded equally.
SPREAD SPECTRUM COMPATIBLE
Many systems being designed now use a technology called Spread Spectrum Frequency Timing Generation. This product is designed not to filter
off the Spread Spectrum feature of the reference input, assuming it exists. When a zero delay buffer is not designed to pass the Spread Spectrum feature
through, the result is a significant amount of tracking skew, which may cause problems in systems requiring synchronization.
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PDF描述 |
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参数描述 |
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