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参数资料
| 型号： | IDT49FCT806APYG |
| 厂商： | INTEGRATED DEVICE TECHNOLOGY INC |
| 元件分类： | 时钟及定时 |
| 英文描述： | FCT SERIES, LOW SKEW CLOCK DRIVER, 0 TRUE OUTPUT(S), 5 INVERTED OUTPUT(S), PDSO20 |
| 封装： | GREEN, SSOP-20 |
| 文件页数： | 6/7页 |
| 文件大小： | 71K |
| 代理商： | IDT49FCT806APYG |
6
COMMERCIALTEMPERATURERANGE
IDT49FCT806/A
FAST CMOSBUFFER/CLOCKDRIVER
7V
V CC
Pu lse
Ge n e ra to r
D.U.T .
500
Ω
50 0
Ω
R T
V IN
V OU T
5 0pF
C L
0V
V OH
tPL H
tPH L
V OL
tR
3V
1.5V
tF
2.0V
0.8V
1.5V
OU T P U T
IN P U T
CO NT ROL
IN P U T
tPLZ
0V
OUT P UT
NO RM A L L Y
LO W
tPZH
0V
SW IT C H
CL O SED
OUT P UT
NO RM A L L Y
HIG H
EN A B L E
D ISA BL E
SW IT C H
O PEN
tPH Z
0V
V OL
V OH
0.3V
1.5V
tPZL
3.5 V
3.5V
3V
1.5V
0V
V OH
tPLH
tPH L
V OL
3V
1.5V
OU T P U T
IN P U T
tSK(p ) = tPH L - tPLH
0V
V OH
tPL H 1
V OL
1.5V
OUT P UT 1
3V
1.5V
IN P U T
V OH
tSK (o)
V OL
1.5V
tSK (o ) = tPLH 2 - tPLH 1 or tPH L2 - tPH L1
OU T P U T 2
tPLH 1
tSK (o)
tPL H 2
tPH L2
0V
V OH
tPLH 1
V OL
1.5V
PA C K A G E 1
OU T P U T
3V
1.5V
IN P U T
V OH
tS K (pp)
V OL
1.5V
tSK (pp) = tPLH2 - tPLH 1 or tPH L2 - tPH L1
tPH L1
tS K (pp)
tPL H 2
tPH L2
PA C K A G E 2
OUT P UT
Package Delay
TEST CIRCUITS AND WAVEFORMS
Pulse Skew - tSK(P)
Test Circuits for All Outputs
DEFINITIONS:
CL = Load capacitance: includes jig and probe capacitance.
RT = Termination resistance: should be equal to ZOUT of the Pulse Generator.
Test
Switch
Disable LOW
Closed
Enable LOW
Disable HIGH
GND
Enable HIGH
SWITCH POSITION
Enable and Disable Times
Output Skew
Part-to-Part Skew - tSK(PP)
NOTES:
1. Diagram shown for input Control Enable-LOW and input Control Disable-HIGH
2. Pulse Generator for All Pulses: Rate
≤ 1.0MHz; tF ≤ 2.5ns; tR ≤ 2.5ns
NOTE:
1. Package 1 and Package 2 are same device type and speed grade.
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