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参数资料
| 型号： | IDT5V40501DCG |
| 厂商： | IDT, Integrated Device Technology Inc |
| 文件页数： | 2/9页 |
| 文件大小： | 0K |
| 描述： | IC CLK GEN PLL 160MHZ 8SOIC |
| 标准包装： | 97 |
| 系列： | LOCO™ |
| 类型： | * |
| PLL： | 是 |
| 输入： | 时钟，晶体 |
| 输出： | LVTTL |
| 电路数： | 1 |
| 比率 - 输入:输出： | 1:1 |
| 差分 - 输入:输出： | 无/无 |
| 频率 - 最大： | 100MHz |
| 除法器/乘法器： | 无/是 |
| 电源电压： | 3.135 V ~ 3.465 V |
| 工作温度： | 0°C ~ 70°C |
| 安装类型： | 表面贴装 |
| 封装/外壳： | 8-SOIC（0.154"，3.90mm 宽） |
| 供应商设备封装： | 8-SOIC |
| 包装： | 管件 |
IDT5V40501
LOCO PLL CLOCK MULTIPLIER
CLOCK MULTIPLIER
IDT LOCO PLL CLOCK MULTIPLIER
2
IDT5V40501
REV C 102808
Pin Assignment
Clock Input Table
0 = connect directly to ground
1 = connect directly to VDD
M = leave unconnected (floating)
Common Output Frequency Examples (MHz)
Pin Descriptions
X1/ I CLK
VDD
GND
OE
S1
S0
CLK
X2
1
2
3
4
8
7
6
5
8 Pi n ( 150 mil) SOIC
S1 S0
CLK
Minimum Input
0
4X input
4 MHz
0
M
5.3125X input
4 MHz
0
1
5X input
3 MHz
M
0
6.25X input
3.5 MHz
M
2X input
7.5 MHz
M
1
3.125X input
7 MHz
1
0
6X input
3 MHz
1
M
3X input
5 MHz
1
8X input
2 mhZ
Output
20
24
30
32
33.33
37.5
40
48
50
60
Input
10
12
10
16
16.66
12
10
12
16.66
10
Selection (S1, S0)
M, M
1, M
M, M
M, 1
0, 0
1, M
1, 0
Output
62.5
64
66.66
72
75
80
83.33
90
100
Input
20
16
16.66
12
10
16.66
15
20
Selection (S1, S0)
M, 1
0, 0
1, 0
M, 0
1, 1
0, 1
1, 0
0, 1
Pin
Number
Pin
Name
Pin
Type
Pin Description
1
XI/ICLK
Input
Crystal connection or clock input.
2
VDD
Power
Connect to +3.3 V.
3
GND
Power
Connect to ground.
4
S1
Tri-level Input
Select 1 for output clock. Connect to GND or VDD or float.
5
CLK
Output
Clock output per table above.
6
S0
Tri-level Input
Select 0 for output clock. Connect to GND or VDD or float.
7
OE
Input
Output enable. Tri-states CLK output when low. Internal pull-up.
8
X2
Output
Crystal connection. Leave unconnected for clock input.
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