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参数资料
| 型号： | IDT5V5206DCGI |
| 厂商： | IDT, Integrated Device Technology Inc |
| 文件页数： | 9/18页 |
| 文件大小： | 0K |
| 描述： | TXRX 1CH M-LVDS TO LVTTL 8-SOIC |
| 标准包装： | 97 |
| 类型： | 收发器 |
| 驱动器/接收器数： | 1/1 |
| 规程： | LVDS |
| 电源电压： | 3 V ~ 3.6 V |
| 安装类型： | 表面贴装 |
| 封装/外壳： | 8-SOIC（0.154"，3.90mm 宽） |
| 供应商设备封装： | 8-SOIC |
| 包装： | 管件 |
| 其它名称： | 5V5206DCGI |
Electrical Specification
17
May 18, 2006
IDT5V5206
Single Channel Type-2 M-LVDS to LVTTL Transceiver
Figure-10 Timing and Voltage Definitions for the Output Signal
Table-10 M-LVDS Type-2 Receiver AC Parameters
Output mode
Symbol
Parameter
Test Condition
Min
Typ Max Unit
LVTTL
tpLH
Delay, Low to High Level
Input clock: freq = 50 MHz, Impedance = 150
, Voltage = -200 mV - 200 mV. See Figure-3
2.5
5.5
6.5
ns
tpHL
Delay, High to Low Level
2.5
5.5
6.5
ns
tsk
Type-2
Pulse Skew, tsk = |tpLH - tpHL|
300
500
ps
Tr (10% - 90%)
Rise Time
1
2.4
ns
Tf (10% - 90%)
Fall Time
1
2.4
ns
Tjit(per)
Period jitter, rms (1 standard deviation)
4
7
ps
Output to Output Skew
200
ps
Table-11 M-LVDS Driver AC Parameter
Symbol
Parameter
Test Condition
Min
Typ
Max
Unit
tpLH
Delay, Low to High Level
Input clock: freq = 15 MHz, Tr = Tf = 1.2 ns,
Impedance = 300
, Voltage = 0 V - 3.3 V. See
2.5
3.7
5.5
ns
tpHL
Delay, High to Low Level
2.5
3.7
5.5
ns
Tsk
LVTTL input
Pulse Skew, tsk = |tpLH - tpHL|
40
100
ps
Tr (10% - 90%)
Rise Time
0.7
1.1
1.5
ns
Tf (10% - 90%)
Fall Time
0.7
1.1
1.5
ns
Tjit(per)
Period jitter, rms(1 standard deviation)
2
3
ps
Output to Output Skew
100
ps
Input
t
pLH
t
pHL
Output
V
s
0.8V
s/0.9Vs
0.2V
s/0.1Vs
0 V
s
t
f
t
r
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