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参数资料
| 型号： | IDT709089L12PFI |
| 厂商： | IDT, Integrated Device Technology Inc |
| 文件页数： | 5/18页 |
| 文件大小： | 0K |
| 描述： | IC SRAM 512KBIT 12NS 100TQFP |
| 标准包装： | 6 |
| 格式 - 存储器： | RAM |
| 存储器类型： | SRAM - 双端口，同步 |
| 存储容量： | 512K (64K x 8) |
| 速度： | 12ns |
| 接口： | 并联 |
| 电源电压： | 4.5 V ~ 5.5 V |
| 工作温度： | -40°C ~ 85°C |
| 封装/外壳： | 100-LQFP |
| 供应商设备封装： | 100-TQFP（14x14） |
| 包装： | 托盘 |
| 其它名称： | 709089L12PFI |
IDT709089/79S/L
High-Speed 64/32K x 8 Synchronous Dual-Port Static RAM
Industrial and Commercial Temperature Ranges
DC Electrical Characteristics Over the Operating
Temperature and Supply Voltage Range (6) (V CC = 5V ± 10%)
709089/79X6
Com'l Only
709089/79X7
Com'l Only
709089/79X9
Com'l Only
Symbol
Parameter
Test Condition
Version
Typ. (4)
Max.
Typ. (4)
Max.
Typ. (4)
Max.
Unit
I CC
Dynamic Operating
Current
(Both Ports Active)
CE L and CE R = V IL
Outputs Disabled
f = f MAX (1)
COM'L
IND
S
L
S
270
270
____
585
525
____
250
250
____
490
440
____
210
210
____
390
350
____
mA
L
____
____
____
____
____
____
I SB1
Standby Current
(Both Ports - TTL
CE L = CE R = V IH
f = f MAX (1)
COM'L
S
L
80
80
205
175
65
65
170
145
50
50
135
115
mA
Level Inputs)
IND
S
L
____
____
____
____
____
____
____
____
____
____
____
____
I SB2
I SB3
I SB4
Standby Current
(One Port - TTL
Level Inputs)
Full Standby Current
(Both Ports -
CMOS Level Inputs)
Full Standby Current
(One Port -
CE "A" = V IL and
CE "B" = V IH (3)
Active Port Outputs
Disabled, f=f MAX (1)
Both Ports CE R and
CE L > V CC - 0.2V
V IN > V CC - 0.2V or
V IN < 0.2V, f = 0 (2)
CE "A" < 0.2V and
CE "B" > V CC - 0.2V (5)
COM'L
IND
COM'L
IND
COM'L
S
L
S
L
S
L
S
L
S
L
180
180
____
____
1.0
0.2
____
____
170
170
405
360
____
____
15
5
____
____
395
340
160
160
____
____
1.0
0.2
____
____
150
150
340
295
____
____
15
5
____
____
330
290
140
140
____
____
1.0
0.2
____
____
130
130
270
240
____
____
15
5
____
____
245
225
mA
mA
mA
CMOS Level Inputs)
V IN > V CC - 0.2V or
V IN < 0.2V, Active Port Outputs
Disabled, f = f MAX (1)
IND
S
L
____
____
____
____
____
____
____
____
____
____
____
____
3242 tbl 09
NOTES:
1. At f = f MAX , address and control lines (except Output Enable) are cycling at the maximum frequency clock cycle of 1/t CYC , using "AC TEST CONDITIONS" at input levels of
GND to 3V.
2. f = 0 means no address, clock, or control lines change. Applies only to input at CMOS level standby.
3. Port "A" may be either left or right port. Port "B" is the opposite from port "A".
4. V CC = 5V, TA = 25°C for Typ, and are not production tested. I CC DC (f=0) = 150mA (Typ).
5. CE X = V IL means CE 0X = V IL and CE 1X = V IH
CE X = V IH means CE 0X = V IH or CE 1X = V IL
CE X < 0.2V means CE 0X < 0.2V and CE 1X > V CC - 0.2V
CE X > V CC - 0.2V means CE 0X > V CC - 0.2V or CE 1X < 0.2V
"X" represents "L" for left port or "R" for right port.
6. 'X' in part numbers indicate power (S or L).
5
6.42
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