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参数资料
| 型号： | IDT709099L7PF |
| 厂商： | IDT, Integrated Device Technology Inc |
| 文件页数： | 3/16页 |
| 文件大小： | 0K |
| 描述： | IC SRAM 1MBIT 7NS 100TQFP |
| 标准包装： | 6 |
| 格式 - 存储器： | RAM |
| 存储器类型： | SRAM - 双端口，同步 |
| 存储容量： | 1M (128K x 8) |
| 速度： | 7ns |
| 接口： | 并联 |
| 电源电压： | 4.5 V ~ 5.5 V |
| 工作温度： | 0°C ~ 70°C |
| 封装/外壳： | 100-LQFP |
| 供应商设备封装： | 100-TQFP（14x14） |
| 包装： | 托盘 |
| 其它名称： | 709099L7PF |
IDT709099L
High-Speed 128K x 8 Synchronous Pipelined Dual-Port Static RAM
Pin Names
Industrial and Commercial Temperature Ranges
Left Port
CE 0L , CE 1L
R/ W L
OE L
A 0L - A 16L
I/O 0L - I/O 7L
CLK L
ADS L
CNTEN L
CNTRST L
FT /PIPE L
Right Port
CE 0R , CE 1R
R/ W R
OE R
A 0R - A 16R
I/O 0R - I/O 7R
CLK R
ADS R
CNTEN R
CNTRST R
FT /PIPE R
V CC
GND
Names
Chip Enables
Read/Write Enable
Output Enable
Address
Data Input/Output
Clock
Address Strobe
Counter Enable
Counter Reset
Flow-Through/Pipeline
Power
Ground
4846 tbl 01
Truth Table I—Read/Write and Enable Control (1,2,3)
OE
X
X
X
L
H
CLK
↑
↑
↑
↑
X
CE 0
H
X
L
L
L
CE 1
X
L
H
H
H
R/ W
X
X
L
H
X
I/O 0-7
High-Z
High-Z
DATA IN
DATA OUT
High-Z
Deselected —Power Down
Deselected —Power Down
Write
Read
Outputs Disabled
Mode
NOTES:
1. "H" = V IH, "L" = V IL, "X" = Don't Care.
2. ADS , CNTEN , CNTRST = X.
3. OE is an asynchronous input signal.
Truth Table II—Address Counter Control (1,2,6)
4846 tbl 02
L
Address
X
An
An
X
Previous
Address
X
X
Ap
Ap
Addr
Used
0
An
Ap
Ap + 1
CLK
↑
↑
↑
↑
ADS
X
L (4)
H
H
CNTEN
X
X
H
(5)
CNTRST
L
H
H
H
I/O (3)
D I/O (0)
D I/O (n)
D I/O (n)
D I/O (n+1)
Mode
Counter Reset to Address 0
External Address Utilized
External Address Blocked—Counter Disabled (Ap reused)
Counter Enable—Internal Address Generation
NOTES:
1. "H" = V IH, "L" = V IL, "X" = Don't Care.
2. CE 0 and OE = V IL ; CE 1 and R/ W = V IH .
3. Outputs configured in Flow-Through Output mode: if outputs are in Pipelined mode the data out will be delayed by one cycle.
4. ADS is independent of all other signals including CE 0 and CE 1 .
5. The address counter advances if CNTEN = V IL on the rising edge of CLK, regardless of all other signals including CE 0 and CE 1 .
6. While an external address is being loaded ( ADS = V IL ), R/ W = V IH is recommended to ensure data is not written arbitrarily.
3
6.42
4846 tbl 03
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