参数资料
型号: IDT70V06L25J
厂商: IDT, Integrated Device Technology Inc
文件页数: 17/23页
文件大小: 0K
描述: IC SRAM 128KBIT 25NS 68PLCC
标准包装: 18
格式 - 存储器: RAM
存储器类型: SRAM - 双端口,异步
存储容量: 128K (16K x 8)
速度: 25ns
接口: 并联
电源电压: 3 V ~ 3.6 V
工作温度: 0°C ~ 70°C
封装/外壳: 68-LCC(J 形引线)
供应商设备封装: 68-PLCC(24x24)
包装: 管件
其它名称: 70V06L25J
IDT70V06S/L
High-Speed 3.3V 16K x 8 Dual-Port Static RAM
Waveform of Interrupt Timing (1) (con't.)
t RC
Industrial and Commercial Temperature Ranges
ADDR "B"
CE "B"
OE "B"
t AS
(3)
t INR
(3)
INTERRUPT CLEAR ADDRESS
(2)
I NT "B"
2942 drw 17
NOTES:
1. All timing is the same for left and right ports. Port “A” may be either the left or right port. Port “B” is the port opposite from “A”.
2. See Interrupt Truth Table III.
3. Timing depends on which enable signal ( CE or R/ W ) is asserted last.
Truth Table III — Interrupt Flag (1)
Left Port
Right Port
L
H
L
H
R/ W L
L
X
X
X
CE L
L
X
X
L
OE L
X
X
X
L
A 13L -A 0L
3FFF
X
X
3FFE
INT L
X
X
(3)
(2)
R/ W R
X
X
L
X
CE R
X
L
L
X
OE R
X
L
X
X
A 13R -A 0R
X
3FFF
3FFE
X
INT R
(2)
(3)
X
X
Function
Set Right INT R Flag
Reset Right INT R Flag
Set Left INT L Flag
Reset Left INT L Flag
NOTES:
1. Assumes BUSY L = BUSY R = V IH .
2. If BUSY L = V IL , then no change.
3. If BUSY R = V IL , then no change.
17
6.42
2942 tbl 15
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