参数资料
型号: IDT70V08L20PFGI8
厂商: IDT, Integrated Device Technology Inc
文件页数: 1/20页
文件大小: 0K
描述: IC SRAM 512KBIT 20NS 100TQFP
标准包装: 750
格式 - 存储器: RAM
存储器类型: SRAM - 双端口,异步
存储容量: 512K (64K x 8)
速度: 20ns
接口: 并联
电源电压: 3 V ~ 3.6 V
工作温度: -40°C ~ 85°C
封装/外壳: 100-LQFP
供应商设备封装: 100-TQFP(14x14)
包装: 带卷 (TR)
其它名称: 70V08L20PFGI8
HIGH-SPEED 3.3V
64K x 8 DUAL-PORT
STATIC RAM
IDT70V08S/L
True Dual-Ported memory cells which allow simultaneous
High-speed access
Low-power operation
Dual chip enables allow for depth expansion without
Features
access of the same memory location
– Commercial: 15/20/25/35ns (max.)
– Industrial: 20ns (max.)
– IDT70V08S
Active: 550mW (typ.)
Standby: 5mW (typ.)
– IDT70V08L
Active: 550mW (typ.)
Standby: 1mW (typ.)
external logic
Functional Block Diagram
R/ W L
CE 0L
CE 1L
OE L
IDT70V08 easily expands data bus width to 16 bits or
more using the Master/Slave select when cascading more
than one device
M/ S = V IH for BUSY output flag on Master,
M/ S = V IL for BUSY input on Slave
Busy and Interrupt Flags
On-chip port arbitration logic
Full on-chip hardware support of semaphore signaling
between ports
Fully asynchronous operation from either port
LVTTL-compatible, single 3.3V (±0.3V) power supply
Available in a 100-pin TQFP
Industrial temperature range (–40°C to +85°C) is available
for selected speeds
Green parts available, see ordering information
R/ W R
CE 0R
CE 1R
OE R
BUSY L
I/O 0-7L
(1,2)
I/O
Control
I/O
Control
I/O 0-7R
BUSY R
(1,2)
A 15L
A 0L
Address
Decoder
64Kx8
MEMORY
ARRAY
70V08
Address
Decoder
A 15R
A 0R
A 15L
A 15R
A 0L
CE 0L
CE 1L
OE L
R/ W L
ARBITRATION
INTERRUPT
SEMAPHORE
LOGIC
A 0R
CE 0R
CE 1R
OE R
R/ W R
I NT L
INT R
SEM L
(2)
M/ S
(1)
3740 drw 01
SEM R
(2)
NOTES:
1. BUSY is an input as a Slave (M/ S -V IL ) and an output when it is a Master (M/ S -V IH ).
2. BUSY and INT are non-tri-state totem-pole outputs (push-pull).
?2008 Integrated Device Technology, Inc.
1
OCTOBER 2008
DSC-3740/7
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