参数资料
型号: IDT70V09L20PFI
厂商: IDT, Integrated Device Technology Inc
文件页数: 13/17页
文件大小: 0K
描述: IC SRAM 1MBIT 20NS 100TQFP
标准包装: 12
格式 - 存储器: RAM
存储器类型: SRAM - 双端口,异步
存储容量: 1M (128K x 8)
速度: 20ns
接口: 并联
电源电压: 3 V ~ 3.6 V
工作温度: -40°C ~ 85°C
封装/外壳: 100-LQFP
供应商设备封装: 100-TQFP(14x14)
包装: 托盘
其它名称: 70V09L20PFI
800-2605
IDT70V09L20PFI-ND
IDT70V09L
High-Speed 128K x 8 Dual-Port Static RAM
Waveform of Interrupt Timing (1,5)
t WC
Industrial and Commercial Temperature Ranges
ADDR "A"
INTERRUPT SET ADDRESS
(2)
t AS
(3)
t WR
(4)
CE "A"
R/ W "A"
t INS
(3)
INT "B"
4852 drw 15
t RC
ADDR "B"
INTERRUPT CLEAR ADDRESS
(3)
t AS
(2)
CE "B"
OE "B"
t INR (3)
INT "B"
4852 drw 16
NOTES:
1. All timing is the same for left and right ports. Port “A” may be either the left or right port. Port “B” is the port opposite from port “A”.
2. Refer to Interrupt Truth Table.
3. Timing depends on which enable signal ( CE or R/ W ) is asserted last.
4. Timing depends on which enable signal ( CE or R/ W ) is de-asserted first.
5. Refer to Truth Table I - Chip Enable.
Truth Table IV — Interrupt Flag (1,4,5)
Left Port
Right Port
L
H
R/ W L
L
X
X
X
CE L
L
X
X
L
OE L
X
X
X
L
A 16L -A 0L
1FFFF
X
X
1FFFE
INT L
X
X
L (3)
H (2)
R/ W R
X
X
L
X
CE R
X
L
L
X
OE R
X
L
X
X
A 16R -A 0R
X
1FFFF
1FFFE
X
INT R
(2)
(3)
X
X
Function
Set Right INT R Flag
Reset Right INT R Flag
Set Left INT L Flag
Reset Left INT L Flag
NOTES:
1. Assumes BUSY L = BUSY R =V IH .
2. If BUSY L = V IL , then no change.
3. If BUSY R = V IL , then no change.
4. INT L and INT R must be initialized at power-up.
5. Refer to Truth Table I - Chip Enable.
13
4852 tbl 16
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