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参数资料
| 型号： | IDT7140LA100C |
| 厂商： | IDT, Integrated Device Technology Inc |
| 文件页数： | 17/21页 |
| 文件大小： | 0K |
| 描述： | IC SRAM 8KBIT 100NS 48DIP |
| 标准包装： | 8 |
| 格式 - 存储器： | RAM |
| 存储器类型： | SRAM - 双端口，异步 |
| 存储容量： | 8K (1K x 8) |
| 速度： | 100ns |
| 接口： | 并联 |
| 电源电压： | 4.5 V ~ 5.5 V |
| 工作温度： | 0°C ~ 70°C |
| 封装/外壳： | 48-DIP（0.600"，15.24mm） |
| 供应商设备封装： | 48-SIDE BRAZED |
| 包装： | 管件 |
| 其它名称： | 7140LA100C |
IDT7130SA/LA and IDT7140SA/LA
High-Speed 1K x 8 Dual-Port Static SRAM
Military, Industrial and Commercial Temperature Ranges
AC Electrical characteristics Over the
Operating Temperature and Supply Voltage Range (1)
7130X55
7140X55
Com'l, Ind
& Military
7130X100
7140X100
Com'l, Ind
& Military
Symbol
Parameter
Min.
Max.
Min.
Max.
Unit
INTERRUPT TIMING
t AS
t WR
t INS
t INR
Address Set-up Time
Write Recovery Time
Interrupt Set Time
Interrupt Reset Time
0
0
____
____
____
____
45
45
0
0
____
____
____
____
60
60
ns
ns
ns
ns
NOTES:
1. 'X' in part numbers indicates power rating (SA or LA).
Timing Waveform of Interrupt Mode (1)
INT Set:
t WC
2689 tbl 12b
INTERRUPT ADDRESS
ADDR 'A'
(2)
t AS (3)
t WR (4)
R/ W 'A'
t INS (3)
INT 'B'
2689 drw 16
INT Clear:
t RC
ADDR 'B'
OE 'B'
t AS
INTERRUPT CLEAR ADDRESS
(3)
t INR
(3)
INT 'A'
2689 drw 17
NOTES: .
1. All timing is the same for left and right ports. Port “A” may be either left or right port. Port “B” is the opposite from port “A”.
2. See Interrupt Truth Table II.
3. Timing depends on which enable signal ( CE or R/ W ) is asserted last.
4. Timing depends on which enable signal ( CE or R/ W ) is de-asserted first.
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PDF描述 |
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| IDT7130LA100C | IC SRAM 8KBIT 100NS 48DIP |
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