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参数资料
| 型号： | IDT71V67603S166PFG |
| 厂商： | IDT, Integrated Device Technology Inc |
| 文件页数： | 7/23页 |
| 文件大小： | 0K |
| 描述： | IC SRAM 9MBIT 166MHZ 100TQFP |
| 标准包装： | 72 |
| 格式 - 存储器： | RAM |
| 存储器类型： | SRAM - 同步 |
| 存储容量： | 9M（256K x 36） |
| 速度： | 166MHz |
| 接口： | 并联 |
| 电源电压： | 3.135 V ~ 3.465 V |
| 工作温度： | 0°C ~ 70°C |
| 封装/外壳： | 100-LQFP |
| 供应商设备封装： | 100-TQFP（14x14） |
| 包装： | 托盘 |
| 其它名称： | 71V67603S166PFG |
IDT71V67603, IDT71V67803, 256K x 36, 512K x 18, 3.3V Synchronous SRAMS with
3.3V I/O, Pipelined Outputs, Single Cycle Deselect Commercial and Industrial Temperature Ranges
Pin Configuration – 256K x 36, 119 BGA
1
2
3
4
5
6
7
A
B
C
D
E
F
G
H
J
K
L
M
N
P
V DDQ
NC
NC
I/O 16
I/O 17
V DDQ
I/O 20
I/O 22
V DDQ
I/O 24
I/O 25
V DDQ
I/O 29
I/O 31
A 6
CS 0 (4)
A 7
I/O P3
I/O 18
I/O 19
I/O 21
I/O 23
V DD
I/O 26
I/O 27
I/O 28
I/O 30
I/O P4
A 4
A 3
A 2
V SS
V SS
V SS
BW 3
V SS
NC
V SS
BW 4
V SS
V SS
V SS
ADSP
ADSC
V DD
NC
CE
OE
ADV
GW
V DD
CLK
NC
BWE
A 1
A 0
A 8
A 9
A 12
V SS
V SS
V SS
BW 2
V SS
NC
V SS
BW 1
V SS
V SS
V SS
A 16
A 17
A 15
I/O P2
I/O 13
I/O 12
I/O 11
I/O 9
V DD
I/O 6
I/O 4
I/O 3
I/O 2
I/O P1
V DDQ
NC
NC
I/O 15
I/O 14
V DDQ
I/O 10
I/O 8
V DDQ
I/O 7
I/O 5
V DDQ
I/O 1
I/O 0
R
T
U
NC
NC
V DDQ
A 5
NC
DNU (3)
LBO
A 10
DNU (3)
V DD
A 11
DNU (3)
V DD / NC (1)
A 14
DNU (3)
A 13
NC
DNU (3)
NC
ZZ (2)
V DDQ
,
5310 drw 04
Top View
Pin Configuration – 512K x 18, 119 BGA
1
2
3
4
5
6
7
A
B
C
D
E
F
G
H
J
K
L
M
N
P
V DDQ
NC
NC
I/O 8
NC
V DDQ
NC
I/O 11
V DDQ
NC
I/O 13
V DDQ
I/O 15
NC
A 6
CS 0 (4)
A 7
NC
I/O 9
NC
I/O 10
NC
V DD
I/O 12
NC
I/O 14
NC
I/O P2
A 4
A 3
A 2
V SS
V SS
V SS
BW 2
V SS
NC
V SS
V SS
V SS
V SS
V SS
ADSP
ADSC
V DD
NC
CE
OE
ADV
GW
V DD
CLK
NC
BWE
A 1
A 0
A 8
A 9
A 13
V SS
V SS
V SS
V SS
V SS
NC
V SS
BW 1
V SS
V SS
V SS
A 16
A 18
A 17
I/O P1
NC
I/O 6
NC
I/O 4
V DD
NC
I/O 2
NC
I/O 1
NC
V DDQ
NC
NC
NC
I/O 7
V DDQ
I/O 5
NC
V DDQ
I/O 3
NC
V DDQ
NC
I/O 0
R
T
U
NC
NC
V DDQ
A 5
A 10
DNU (3)
LBO
A 15
DNU (3)
V DD
NC
DNU (3)
V DD / NC
A 14
DNU (3)
(1)
A 12
A 11
DNU (3)
NC
ZZ (2)
V DDQ
,
5310 drw 05
Top View
NOTES:
1. R5 can either be directly connected to V DD , or connected to an input voltage ≥ V IH , or left unconnected.
2. T7 can be left unconnected and the device will always remain in active mode.
3. DNU= Do not use; these signals can either be left unconnected or tied to Vss.
4. On future 18M device CS 0 will be removed, B2 will be used for address expansion.
7
6.42
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