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参数资料
| 型号： | IDT72255LA15PFI |
| 厂商： | IDT, Integrated Device Technology Inc |
| 文件页数： | 3/27页 |
| 文件大小： | 0K |
| 描述： | IC FIFO 8KX18 LP 15NS 64QFP |
| 标准包装： | 90 |
| 系列： | 7200 |
| 功能： | 同步 |
| 存储容量： | 144K（8K x 18） |
| 访问时间： | 15ns |
| 电源电压： | 4 V ~ 5.5 V |
| 工作温度： | -40°C ~ 85°C |
| 安装类型： | 表面贴装 |
| 封装/外壳： | 64-LQFP |
| 供应商设备封装： | 64-TQFP（14x14） |
| 包装： | 托盘 |
| 其它名称： | 72255LA15PFI |
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11
IDT72255LA/72265LA CMOS SuperSync FIFO
8,192 x 18 and 16,384 x 18
COMMERCIAL AND INDUSTRIAL
TEMPERATURE RANGES
JANUARY 13, 2009
enable the rising edge of RCLK. See Figure 12, Retransmit Timing (FWFT
Mode), for the relevant timing diagram.
For either IDT Standard mode or FWFT mode, updating of the
PAE,
HF and PAF flags begin with the rising edge of RCLK that RT is setup.
PAE is synchronized to RCLK, thus on the second rising edge of RCLK
after
RT is setup, the PAE flag will be updated. HF is asynchronous, thus
the rising edge of RCLK that
RT is setup will update HF. PAF is synchro-
nized to WCLK, thus the second rising edge of WCLK that occurs tSKEW
after the rising edge of RCLK that
RT is setup will update PAF. RT is
synchronized to RCLK.
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PDF描述 |
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参数描述 |
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