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参数资料
| 型号： | IDT72291L15PFI8 |
| 厂商： | IDT, Integrated Device Technology Inc |
| 文件页数： | 15/26页 |
| 文件大小： | 0K |
| 描述： | IC FIFO 65536X18 LP 15NS 64QFP |
| 标准包装： | 750 |
| 系列： | 7200 |
| 功能： | 同步 |
| 存储容量： | 1.1M（65K x 18） |
| 数据速率： | 67MHz |
| 访问时间： | 15ns |
| 电源电压： | 4.5 V ~ 5.5 V |
| 工作温度： | -40°C ~ 85°C |
| 安装类型： | 表面贴装 |
| 封装/外壳： | 64-LQFP |
| 供应商设备封装： | 64-TQFP（14x14） |
| 包装： | 带卷 (TR) |
| 其它名称： | 72291L15PFI8 |
COMMERCIALANDINDUSTRIAL
TEMPERATURERANGES
IDT72281/72291
CMOS SuperSync FIFO 65,536 x 9 and 131,072 x 9
22
WCLK
LD
WEN
D0 - D7
tLDS
tENS
PAE OFFSET
(LSB)
tDS
tDH
tENH
PAF OFFSET
(LSB)
PAF OFFSET
(MSB)
4675 drw 17
tLDH
tDH
tCLKL
tLDH
PAE OFFSET
(MSB)
tCLK
tCLKH
tENH
WCLK
LD
WEN
D0 - D7
tLDS
tENS
PAE OFFSET
(LSB)
PAE OFFSET
(MID-BYTE)
tDS
tDH
tENH
PAE OFFSET
(MSB)
PAF OFFSET
(LSB)
4675 drw 18
PAF OFFSET
(MID-BYTE)
PAF OFFSET
(MSB)
tLDH
tDH
tLDH
tCLK
tCLKH
tCLKL
tENH
Figure 15. Parallel Loading of Programmable Flag Registers (IDT Standard and FWFT Modes) for the IDT72291
Figure 14. Parallel Loading of Programmable Flag Registers (IDT Standard and FWFT Modes) for the IDT72281
RCLK
LD
REN
Q0 - Q7
tLDH
tLDS
tENS
DATA IN OUTPUT
REGISTER
tENH
4675 drw 19
t CLK
tA
PAF OFFSET
(MSB)
PAF OFFSET
(LSB)
PAE OFFSET
(MSB)
PAE OFFSET
(LSB)
tENH
tLDH
tCLKH
tCLKL
LD
REN
tLDH
tLDS
tENS
tENH
4675 drw 20
RCLK
Q0 - Q7
DATA IN OUTPUT REGISTER
PAE OFFSET
(MSB)
PAF OFFSET
(MSB)
PAE OFFSET
(MID-BYTE)
PAE OFFSET
(LSB)
PAF OFFSET
(MID-BYTE)
PAF OFFSET
(LSB)
tA
tCLK
tCLKH
tCLKL
Figure 16. Parallel Read of Programmable Flag Registers (IDT Standard and FWFT Modes) for the IDT72281
NOTE:
1. OE = LOW.
Figure 17. Parallel Read of Programmable Flag Registers (IDT Standard and FWFT Modes) for the IDT72291
NOTE:
1. OE = LOW.
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PDF描述 |
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| IDT72285L15PFI8 | IC FIFO 65536X18 LP 15NS 64-TQFP |
相关代理商/技术参数 |
参数描述 |
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