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参数资料
| 型号： | IDT723616L15PFG |
| 厂商： | IDT, Integrated Device Technology Inc |
| 文件页数： | 17/26页 |
| 文件大小： | 0K |
| 描述： | IC FIFO 64X36X2 15NS 128TQFP |
| 标准包装： | 72 |
| 系列： | 7200 |
| 功能： | 同步 |
| 存储容量： | 4.6K（64 x 36 x2） |
| 数据速率： | 67MHz |
| 访问时间： | 15ns |
| 电源电压： | 4.5 V ~ 5.5 V |
| 工作温度： | 0°C ~ 70°C |
| 安装类型： | 表面贴装 |
| 封装/外壳： | 128-LQFP |
| 供应商设备封装： | 128-TQFP（14x20） |
| 包装： | 托盘 |
24
COMMERCIALANDINDUSTRIAL
TEMPERATURERANGES
IDT723616 CMOS TRIPLE BUS SyncFIFO
WITH
BUS-MATCHING AND BYTE SWAPPING 64 x 36 x 2
AFA
CLKA
RENB
3520 drw18
ENA
CLKB
1
2
tSKEW2
tENS
tENH
tPAF
tENS
tENH
tPAF
[64-(X+1)] Long Words in FIFO1
(64-X) Long Words in FIFO1
(1)
NOTES:
1. tSKEW2 is the minimum time between a rising CLKA edge and a rising CLKB edge for
AFA to transition HIGH in the next CLKA cycle. If the time between the rising CLKA
edge and rising CLKB edge is less than tSKEW2, then
AFA may transition HIGH one CLKB cycle later than shown.
2. FIFO1 Write (
CSA = LOW, W/RA = HIGH).
3. Port-B size is word or byte; tSKEW2 is referenced from the last word or byte read of the long word, respectively.
Figure 18. Timing for
AFA
AFA when FIFO1 is Almost-Full
Figure 20. ODD/EVEN, W/
R
RR
RRA and PGA to PEFA
PEFA
PEFA Timing
AFC
CLKC
ENA
3520drw19
WENC
CLKA
12
tSKEW2
tENS
tENH
tPAF
tENS
tENH
tPAF
[64-(X+1)] Long Words in FIFO2
(64-X) Long Words in FIFO2
(1)
NOTES:
1. tSKEW2 is the minimum time between a rising CLKC edge and a rising CLKA edge for
AFC to transition HIGH in the next CLKC cycle. If the time between the rising
CLKC edge and rising CLKA edge is less than tSKEW2, then
AFC may transition HIGH one CLKA cycle later than shown.
2. Port-C size is word or byte;
AFC is set LOW by the last word or byte read of the long word, respectively.
Figure 19. Timing for
AFC
AFC when FIFO2 is Almost-Full
3520 drw20
ODD/
EVEN
PEFA
PGA
W/RA
Valid
tPOPE
tPEPE
tPOPE
tPEPE
3520 drw21
ODD/
EVEN
PEFC
Valid
tPOPE
Figure 21. ODD/
EVEN
EVEN to PEFC
PEFC
PEFC Timing
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PDF描述 |
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