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参数资料
| 型号： | IDT723663L15PF |
| 厂商： | IDT, Integrated Device Technology Inc |
| 文件页数： | 9/29页 |
| 文件大小： | 0K |
| 描述： | IC FIFO SYNC 4096X36 128QFP |
| 标准包装： | 36 |
| 系列： | 7200 |
| 功能： | 同步 |
| 存储容量： | 147K（4K x 36） |
| 数据速率： | 67MHz |
| 访问时间： | 15ns |
| 电源电压： | 4.5 V ~ 5.5 V |
| 工作温度： | 0°C ~ 70°C |
| 安装类型： | 表面贴装 |
| 封装/外壳： | 128-LQFP |
| 供应商设备封装： | 128-TQFP（14x20） |
| 包装： | 托盘 |
| 其它名称： | 723663L15PF |
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17
COMMERCIALTEMPERATURERANGE
IDT723653/723663/723673 CMOS SyncFIFOTM WITH BUS-MATCHING
2,048 x 36 x 2, 4,096 x 36 x 2 and 8,192 x 36 x 2
Figure 6. Serial Programming of the Almost-Full Flag and Almost-Empty Flag Offset Values after Reset
(IDT Standard and FWFT Modes)
NOTE:
1.
CSA = LOW, W/RA = HIGH, MBA = LOW.
Figure 5. Parallel Programming of the Almost-Full Flag and Almost-Empty Flag Offset Values after Reset
(IDT Standard and FWFT Modes)
NOTES:
1. It is not necessary to program offset register bits on consecutive clock cycles. FIFO write attempts are ignored until
FF/IR is set HIGH.
2. Programmable offsets are written serially to the SD input in the order
AF offset (Y) and AE offset (X).
5610 drw 07
CLKA
RS1
FF/IR
A0-A35
FS1,FS0
ENA
tFSH
tWFF
tENH
tENS2
tDS
tDH
4
0,0
AF Offset
(Y)
AE Offset
(X)
First Word to FIFO1
tFSH
tFSS
FS2
tFSS
1
2
CLKA
FF/IR
tSENS
tSENH
FS0/SD(2)
tSPH
tSENS
tSENH
tFSS
tWFF
FS1/SEN
AE Offset
(X) LSB
tSDS
tSDH
tSDS
tSDH
AF Offset
(Y) MSB
RS1
4
tFSS
tFSH
FS2
5610 drw 08
相关PDF资料 |
PDF描述 |
|---|---|
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相关代理商/技术参数 |
参数描述 |
|---|---|
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| IDT723664L15PF | 功能描述:IC FIFO BI SYNC 8192X36 128QFP RoHS:否 类别:集成电路 (IC) >> 逻辑 - FIFO 系列:7200 标准包装:15 系列:74F 功能:异步 存储容量:256（64 x 4） 数据速率:- 访问时间:- 电源电压:4.5 V ~ 5.5 V 工作温度:0°C ~ 70°C 安装类型:通孔 封装/外壳:24-DIP（0.300"，7.62mm） 供应商设备封装:24-PDIP 包装:管件 其它名称:74F433 |
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