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参数资料
| 型号： | IDT72403L15SO8 |
| 厂商： | IDT, Integrated Device Technology Inc |
| 文件页数： | 6/9页 |
| 文件大小： | 0K |
| 描述： | IC FIFO PAR 64X4 15NS 16-SOIC |
| 标准包装： | 1,000 |
| 系列： | 7200 |
| 功能： | 异步 |
| 存储容量： | 256（64 x 4） |
| 数据速率： | 15MHz |
| 访问时间： | 15ns |
| 电源电压： | 4.5 V ~ 5.5 V |
| 工作温度： | 0°C ~ 70°C |
| 安装类型： | 表面贴装 |
| 封装/外壳： | 16-SOIC（0.295"，7.50mm 宽） |
| 供应商设备封装： | 16-SOIC |
| 包装： | 带卷 (TR) |
| 其它名称： | 72403L15SO8 |
MILITARY AND COMMERCIAL
TEMPERATURE RANGES
IDT72401/72403
CMOS PARALLEL FIFO 64 x 4, 64 x 5
6
JUNE 29, 2012
Figure 6. The Mechanism of Shifting Data Out of the FIFO
NOTES:
1. OR HIGH indicates that data is available and a SO pulse may be applied.
2. SO goes HIGH causing the next step.
3. OR goes LOW.
4. The read pointer is incremented.
5. OR goes HIGH indicating that new data (B) is now available at the FIFO outputs.
6. If the FIFO has only one word loaded (A DATA) then OR stays LOW and the A DATA remains unchanged at the outputs.
7. SO pulses applied when OR is LOW will be ignored.
Figure 5. Output TIming
STABLE DATA
SO
SI
IR
INPUT DATA
(2)
(3)
(1)
tIPH
tPT
(4)
(5)
2747 drw 08
tHIR
tSIR
NOTES:
1. FIFO is initially full.
2. SO pulse is applied.
3. SI is held HIGH.
4. As soon as IR becomes HIGH the Input Data is loaded into the FIFO.
5. The write pointer is incremented. SI should not go LOW until (tPT + tIPH).
Figure 4. Data is Shifted In Whenever Shift In and Input Ready are Both HIGH
SO
OR
OUTPUT DATA
A- DATA
(2)
(3)
(5)
2747 drw 10
(6)
(4)
(1)
(7)
A or B
B- DATA
SO
OR
OUTPUT DATA
tORL
2747 drw 09
1/fOUT
tSOH
tSOL
tODH
tORH
C-DATA
B-DATA
A-DATA
tODS
(2)
(1)
NOTES:
1. This data is loaded consecutively A, B, C.
2. Data is shifted out when SO makes a HIGH to LOW transition.
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PDF描述 |
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| IDT72401L15SO8 | IC FIFO PAR 64X4 15NS 16-SOIC |
| IDT72V01L35J8 | IC ASYNCH 512X9 35NS 32-PLCC |
| IDT72V01L25J8 | IC ASYNCH 512X9 25NS 32-PLCC |
相关代理商/技术参数 |
参数描述 |
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