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参数资料
| 型号： | IDT72413L25SO8 |
| 厂商： | IDT, Integrated Device Technology Inc |
| 文件页数： | 10/10页 |
| 文件大小： | 0K |
| 描述： | IC FIFO PAR W/FLAGS 32KB 20SOIC |
| 标准包装： | 1,000 |
| 系列： | 7200 |
| 功能： | 异步 |
| 存储容量： | 32K |
| 数据速率： | 25MHz |
| 访问时间： | 25ns |
| 电源电压： | 4.5 V ~ 5.5 V |
| 工作温度： | 0°C ~ 70°C |
| 安装类型： | 表面贴装 |
| 封装/外壳： | 20-SOIC（0.295"，7.50mm 宽） |
| 供应商设备封装： | 20-SOIC |
| 包装： | 带卷 (TR) |
| 其它名称： | 72413L25SO8 |
9
IDT72413 CMOS PARALLEL FIFO WITH FLAGS
64 x 5
COMMERCIALTEMPERATURERANGE
JUNE 29, 2012
NOTE:
1. Cascading the FIFOs in word width is done by ANDing the IR and OR as shown in Figure 13.
Figure 14. Application for IDT72413 for Two Asynchronous Systems
NOTE:
1. FIFOs are expandable in width. However, in forming wider words two external gates are required to generate composite Input and Output Ready flags. This requirement
is due to the different fall-through times of the FIFOs.
Figure 13. 64 x 15 FIFO with IDT72413
2748 drw 15
D0
D1
D2
D3
IR
SI
Q0
Q1
Q2
Q3
SO
OR
MR
COMPOSITE
OUTPUT
READY
SHIFT IN
COMPOSITE
INPUT
READY
HF
AF/E
OE
D4
Q4
D0
D1
D2
D3
IR
SI
Q0
Q1
Q2
Q3
SO
OR
MR
HF
AF/E
OE
D4
Q4
D0
D1
D2
D3
IR
SI
Q0
Q1
Q2
Q3
SO
OR
MR
HF
AF/E
OE
D4
Q4
OUTPUT
ENABLE
MASTER
RESET
SHIFT OUT
2748 drw 16
SYSTEM 1
ENBL SI
TWO
IDT72413
64 x 8
OR
SO
IR
SI
8-BITS
SYSTEM 2
IO RDY
ALMOST-FULL/
EMPTY
HALF-FULL FLAG
INTERRUPT
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PDF描述 |
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参数描述 |
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