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参数资料
| 型号： | IDT72413L35SO8 |
| 厂商： | IDT, Integrated Device Technology Inc |
| 文件页数： | 7/10页 |
| 文件大小： | 0K |
| 描述： | IC FIFO PAR W/FLAGS 32KB 20SOIC |
| 标准包装： | 1,000 |
| 系列： | 7200 |
| 功能： | 异步 |
| 存储容量： | 32K |
| 访问时间： | 35ns |
| 电源电压： | 4.5 V ~ 5.5 V |
| 工作温度： | 0°C ~ 70°C |
| 安装类型： | 表面贴装 |
| 封装/外壳： | 20-SOIC（0.295"，7.50mm 宽） |
| 供应商设备封装： | 20-SOIC |
| 包装： | 带卷 (TR) |
| 其它名称： | 72413L35SO8 |
6
IDT72413 CMOS PARALLEL FIFO WITH FLAGS
64 x 5
COMMERCIALTEMPERATURERANGE
JUNE 29, 2012
Figure 6. The Mechanism of Shifting Data Out of the FIFO
NOTES:
1. OR HIGH indicates that data is available and a SO pulse may be applied.
2. SO goes HIGH causing the next step.
3. OR goes LOW.
4. Read pointer is incremented.
5. OR goes HIGH indicating that new data (B) will be available at the FIFO outputs after tORD ns.
6. If the FIFO has only one word loaded (A DATA) , OR stays LOW and the A-DATA remains unchanged at the outputs.
7. SO pulses applied when OR is LOW will be ignored.
NOTES:
1. FIFO is initially full.
2. SO pulse is applied.
3. SI is held HIGH.
4. As soon as IR becomes HIGH the Input Data is loaded into the FIFO.
5. The write pointer is incremented. SI should not go LOW until (tPT + tIPH).
Figure 4. Data is Shifted In Whenever Shift In and Input Ready are Both HIGH
NOTES:
1. This data is loaded consecutively A, B, C.
2. Output data changes on the falling edge of SO after a valid SO sequence, i.e., OR and SO are both HIGH together.
Figure 5. Output TIming
STABLE DATA
SO
SI
IR
INPUT DATA
(2)
(3)
(1)
tIPH
tPT
(4)
(5)
2748 drw 06
SO
OR
OUTPUT DATA
tORL
2748 drw 07
1/fOUT
tSOH
tSOL
tRH
tODH
tORD
C-DATA
B-DATA
A-DATA
tODS
(2)
(1)
SO
OR
OUTPUT DATA
A- DATA
(2)
(3)
(5)
2748 drw 08
(6)
(4)
(1)
(7)
A or B
B- DATA
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