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参数资料
| 型号： | IDT72V235L15PFI8 |
| 厂商： | IDT, Integrated Device Technology Inc |
| 文件页数： | 15/25页 |
| 文件大小： | 0K |
| 描述： | IC FIFO SYNC 2048X18 15NS 64TQFP |
| 标准包装： | 750 |
| 系列： | 72V |
| 功能： | 同步 |
| 存储容量： | 36.8K（2K x 18） |
| 数据速率： | 67MHz |
| 访问时间： | 15ns |
| 电源电压： | 3 V ~ 3.6 V |
| 工作温度： | -40°C ~ 85°C |
| 安装类型： | 表面贴装 |
| 封装/外壳： | 64-LQFP |
| 供应商设备封装： | 64-TQFP（14x14） |
| 包装： | 带卷 (TR) |
| 其它名称： | 72V235L15PFI8 |
22
IDT72V205/72V215/72V225/72V235/72V245 3.3V CMOS SyncFIFOTM
256 x 18, 512 x 18, 1,024 x 18, 2,048 x 18 and 4,096 x 18
COMMERCIALANDINDUSTRIAL
TEMPERATURERANGES
MARCH 2013
OPERATINGCONFIGURATIONS
SINGLE DEVICE CONFIGURATION
AsingleIDT72V205/72V215/72V225/72V235/72V245maybeusedwhen
theapplicationrequirementsarefor256/512/1,024/2,048/4,096wordsorless.
These FIFOs are in a single Device Configuration when the First Load (FL),
Write Expansion In (WXI) and Read Expansion In (RXI) control inputs are
configured as (FL, RXI, WXI = (0,0,0), (0,0,1), (0,1,0), (1,0,0), (1,0,1) or
(1,1,0) during reset (Figure 28).
Figure 28. Block Diagram of Single 256 x 18, 512 x 18, 1,024 x 18, 2,048 x 18, 4,096 x 18 Synchronous FIFO
NOTE:
1. Do not connect any output control signals directly together.
Figure 29. Block Diagram of 256 x 36, 512 x 36, 1,024 x 36, 2,048 x 36, 4,096 x 36
Synchronous FIFO Memory Used in a Width Expansion Configuration
WIDTH EXPANSION CONFIGURATION
Word width may be increased simply by connecting together the control
signalsofmultipledevices. Statusflagscanbedetectedfromanyonedevice.
TheexceptionsaretheEmptyFlag/OutputReadyandFullFlag/InputReady.
BecauseofvariationsinskewbetweenRCLKandWCLK,itispossibleforflag
assertion and deassertion to vary by one cycle between FIFOs. To avoid
problemstheusermustcreatecompositeflagsbygatingtheEmptyFlags/Output
ReadyofeveryFIFO,andseparatelygatingallFullFlags/InputReady. Figure
29demonstratesa36-wordwidthbyusingtwoIDT72V205/72V215/72V225/
72V235/72V245s. Any word width can be attained by adding additional
IDT72V205/72V215/72V225/72V235/72V245s. TheseFIFOsareinasingle
DeviceConfigurationwhentheFirstLoad(FL),WriteExpansionIn(WXI)and
Read Expansion In (RXI) control inputs are configured as (FL, RXI,
WXI = (0,0,0), (0,0,1), (0,1,0), (1,0,0), (1,0,1) or (1,1,0) during reset (Figure
29). Please see the Application Note AN-83.
WRITE CLOCK (WCLK)
WRITE ENABLE (
WEN)
READ CLOCK (RCLK)
READ ENABLE (
REN)
LOAD (
LD)
OUTPUT ENABLE (
OE)
DATA IN (D)
DATA OUT (Q)
FULL FLAG/INPUT
READY (
FF/IR)
PROGRAMMABLE (
PAE)
HALF FULL FLAG (
HF)
EMPTY FLAG/OUTPUT
READY (
EF/OR)
PROGRAMMABLE (
PAF)
RESET (
RS)
72V205
72V215
72V225
72V235
72V245
72V205
72V215
72V225
72V235
72V245
RESET (
RS)
36
18
FF/IR
EF/OR
4294 drw 29
FL WXI RXI
FF/IR
EF/OR
WRITE CLOCK (WCLK)
WRITE ENABLE (
WEN)
READ CLOCK (RCLK)
READ ENABLE (
REN)
LOAD (
LD)
OUTPUT ENABLE (
OE)
DATA IN (D0 - D17)
DATA OUT (Q0 - Q17)
FULL FLAG/INPUT READY (
FF/IR)
PROGRAMMABLE (
PAE)
HALF-FULL FLAG (
HF)
EMPTY FLAG/OUTPUT READY (
EF/OR)
PROGRAMMABLE (
PAF)
RESET (
RS)
IDT
72V205
72V215
72V225
72V235
72V245
4294 drw 28
FL
RXI
WXI
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