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参数资料
| 型号： | IDT72V291L10TFG |
| 厂商： | IDT, Integrated Device Technology Inc |
| 文件页数： | 15/26页 |
| 文件大小： | 0K |
| 描述： | IC FIFO SS 32768X36 10NS 64QFP |
| 标准包装： | 80 |
| 系列： | 72V |
| 功能： | 同步 |
| 存储容量： | 1.1M（32K x 36） |
| 数据速率： | 100MHz |
| 访问时间： | 10ns |
| 电源电压： | 3 V ~ 3.6 V |
| 工作温度： | 0°C ~ 70°C |
| 安装类型： | 表面贴装 |
| 封装/外壳： | 64-LQFP |
| 供应商设备封装： | 64-TQFP（10x10） |
| 包装： | 托盘 |
| 其它名称： | 72V291L10TFG |
22
COMMERCIAL AND INDUSTRIAL
TEMPERATURE RANGES
IDT72V281/72V291 3.3V CMOS SUPERSYNC FIFOTM
65,536 x 9 and 131,072 x 9
Figure 15. Parallel Loading of Programmable Flag Registers (IDT Standard and FWFT Modes) for the IDT72V291
Figure 14. Parallel Loading of Programmable Flag Registers (IDT Standard and FWFT Modes) for the IDT72V281
Figure 16. Parallel Read of Programmable Flag Registers (IDT Standard and FWFT Modes) for the IDT72V281
NOTE:
1.
OE = LOW
Figure 17. Parallel Read of Programmable Flag Registers (IDT Standard and FWFT Modes) for the IDT72V291
NOTE:
1.
OE = LOW
LD
REN
tLDH
tLDS
tENS
tENH
4513 drw 20
RCLK
Q0 - Q7
DATA IN OUTPUT REGISTER
PAE OFFSET
(MSB)
PAF OFFSET
(MSB)
PAE OFFSET
(MID-BYTE)
PAE OFFSET
(LSB)
PAF OFFSET
(MID-BYTE)
PAF OFFSET
(LSB)
tCLKL
tCLKH
tCLK
tA
RCLK
LD
REN
Q0 - Q7
tLDH
tLDS
tENS
DATA IN OUTPUT REGISTER
tENH
tLDH
4513 drw 19
t CLK
tA
tCLKH
tCLKL
PAF OFFSET
(MSB)
PAF OFFSET
(LSB)
PAE OFFSET
(MSB)
PAE OFFSET
(LSB)
WCLK
LD
WEN
D0 - D7
tLDS
tENS
PAE OFFSET
(LSB)
PAE OFFSET
(MID-BYTE)
tDS
tDH
tENH
PAE OFFSET
(MSB)
PAF OFFSET
(LSB)
4513 drw 18
PAF OFFSET
(MID-BYTE)
PAF OFFSET
(MSB)
tLDH
tCLK
tDH
tCLKH
tCLKL
tLDH
tENH
WCLK
LD
WEN
D0 - D7
tLDS
tENS
PAE OFFSET
(LSB)
tDS
tDH
tENH
PAF OFFSET
(LSB)
PAF OFFSET
(MSB)
4513 drw 17
tLDH
tCLK
tDH
tCLKH
tCLKL
tLDH
tENH
PAE OFFSET
(MSB)
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PDF描述 |
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参数描述 |
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