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参数资料
| 型号： | IDT74FCT162374ATEG |
| 厂商： | INTEGRATED DEVICE TECHNOLOGY INC |
| 元件分类： | 总线收发器 |
| 英文描述： | FCT SERIES, DUAL 8-BIT DRIVER, TRUE OUTPUT, CDFP48 |
| 封装： | 0.635 INCH PITCH, CERPACK-48 |
| 文件页数： | 5/7页 |
| 文件大小： | 107K |
| 代理商： | IDT74FCT162374ATEG |
5
IDT54/74FCT162374T/AT/CT/ET
FAST CMOS 16-BIT REGISTER (3-STATE)
MILITARYANDCOMMERCIALTEMPERATURERANGES
SWITCHING CHARACTERISTICS OVER OPERATING RANGE
FCT162374T
FCT162374AT
Com'l.
Mil.
Com'l.
Mil.
Symbol
Parameter
Condition(1)
Min.(2)
Max.
Min.(2)
Max.
Min.(2)
Max.
Min.(2)
Max.
Unit
tPLH
tPHL
Propagation Delay
xCLK to xOx
CL = 50pF
RL = 500
2102112
6.5
2
7.2
ns
tPZH
tPZL
Output Enable Time
1.5
12.5
1.5
14
1.5
6.5
1.5
7.5
ns
tPHZ
tPLZ
Output Disable Time
1.5
8
1.5
8
1.5
5.5
1.5
6.5
ns
tSU
Set-up Time HIGH or LOW, xDx to xCLK
2
—
2
—
2
—
2
—
ns
tH
Hold Time HIGH or LOW, xDx to xCLK
1.5
—
1.5
—
1.5
—
1.5
—
ns
tW
xCLK Pulse Width HIGH or LOW
7
—
7
—
5
—
6
—
ns
tSK(o)
Output Skew(3)
—0.5
ns
FCT162374CT
FCT162374ET
Com'l.
Mil.
Com'l.
Mil.
Symbol
Parameter
Condition(1)
Min.(2)
Max.
Min.(2)
Max.
Min.(2)
Max.
Min.(2)
Max.
Unit
tPLH
tPHL
Propagation Delay
xCLK to xOx
CL = 50pF
RL = 500
2
5.2
2
6.2
1.5
3.7
—
ns
tPZH
tPZL
Output Enable Time
1.5
5.5
1.5
6.2
1.5
4.4
—
ns
tPHZ
tPLZ
Output Disable Time
1.5
5
1.5
5.7
1.5
3.6
—
ns
tSU
Set-up Time HIGH or LOW, xDx to xCLK
2
—
2
—
1.5
—
ns
tH
Hold Time HIGH or LOW, xDx to xCLK
1.5
—
1.5
—
0
—
ns
tW
xCLK Pulse Width HIGH or LOW
5
—
6
—
3(4)
———
ns
tSK(o)
Output Skew(3)
—0.5
—
ns
NOTES:
1. See test circuit and waveforms.
2. Minimum limits are guaranteed but not tested on Propagation Delays.
3. Skew between any two outputs of the same package switching in the same direction. This parameter is guaranteed by design.
4. This limit is guaranteed but not tested.
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