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参数资料
| 型号： | IDT74FCT162652CTPA8 |
| 厂商： | INTEGRATED DEVICE TECHNOLOGY INC |
| 元件分类： | 总线收发器 |
| 英文描述： | FCT SERIES, DUAL 8-BIT REGISTERED TRANSCEIVER, TRUE OUTPUT, PDSO56 |
| 封装： | TSSOP-56 |
| 文件页数： | 7/9页 |
| 文件大小： | 103K |
| 代理商： | IDT74FCT162652CTPA8 |
7
IDT54/74FCT162652T/AT/CT
FASTCMOS16-BITBUSTRANSCEIVER/REGISTER
MILITARYANDINDUSTRIALTEMPERATURERANGES
54FCT162652T
54/74FCT162652AT
54/74FCT162652CT
Mil.
Ind.
Mil.
Ind.
Mil.
Symbol
Parameter
Condition(1)
Min.(2) Max. Min.(2) Max. Min.(2)
Max.
Min.(2) Max. Min.(2) Max.
Unit
tPLH
Propagation Delay
CL = 50pF
2
11
2
6.3
2
7.7
1.5
3.9
1.5
6
ns
tPHL
Bus to Bus
RL = 500
tPZH
Output Enable Time
2
15
2
9.8
2
10.5
1.5
4.8
1.5
8.9
ns
tPZL
xOEAB or xOEBA to Bus
tPHZ
Output Disable Time
2
11
2
6.3
2
7.7
1.5
4.4
1.5
7.7
ns
tPLZ
xOEAB or xOEBA to Bus
tPLH
Propagation Delay
2
10
2
6.3
2
7
1.5
4.1
1.5
6.3
ns
tPHL
Clock to Bus
tPLH
Propagation Delay xSBA or xSAB to Bus
2
12
2
7.7
2
8.4
1.5
4.2
1.5
7
ns
tPHL
tSU
Set-up Time HIGH or LOW Bus to Clock
4.5
—
2
—
2
—
2
—
2
—
ns
tH
Hold Time HIGH or LOW Bus to Clock
2
—
1.5
—
1.5
—
0
—
1.5
—
ns
tW
Clock Pulse Width HIGH or LOW
6
—
5
—
5
—
3
—
5
—
ns
tSK(o)
Output Skew(3)
—
0.5
—
0.5
—
0.5
—
0.5
—
0.5
ns
NOTES:
1. See test circuit and waveforms.
2. Minimum limits are guaranteed but not tested on Propagation Delays.
3. Skew between any two outputs of the same package switching in the same direction. This parameter is guaranteed by design.
SWITCHING CHARACTERISTICS OVER OPERATING RANGE
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PDF描述 |
|---|---|
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相关代理商/技术参数 |
参数描述 |
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| IDT74FCT162823ATPV | 制造商:Integrated Device Technology Inc 功能描述: |
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