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参数资料
| 型号： | IDT74FCT16374ETPAG8 |
| 厂商： | INTEGRATED DEVICE TECHNOLOGY INC |
| 元件分类： | 总线收发器 |
| 英文描述： | FCT SERIES, DUAL 8-BIT DRIVER, TRUE OUTPUT, PDSO48 |
| 封装： | GREEN, TSSOP-48 |
| 文件页数： | 5/7页 |
| 文件大小： | 77K |
| 代理商： | IDT74FCT16374ETPAG8 |
5
IDT54/74FCT16374AT/CT/ET
FAST CMOS 16-BIT REGISTER (3-STATE)
MILITARYANDINDUSTRIALTEMPERATURERANGES
SWITCHING CHARACTERISTICS OVER OPERATING RANGE
NOTES:
1. See test circuit and waveforms.
2. Minimum limits are guaranteed but not tested on Propagation Delays.
3. Skew between any two outputs, of the same package, switching in the same direction. This parameter is guaranteed by design.
4. This limit is guaranteed but not tested.
FCT16374AT
Ind.
Mil.
Symbol
Parameter
Condition(2)
Min.(2)
Max.
Min.(2)
Max.
Unit
tPLH
PropagationDelay
CL = 50pF
2
6.5
2
7.2
ns
tPHL
xCLK to xOx
RL = 500
Ω
tPZH
OutputEnableTime
1.5
6.5
1.5
7.5
ns
tPZL
tPHZ
OutputDisableTime
1.5
5.5
1.5
6.5
ns
tPLZ
tSU
Set-up Time HIGH or LOW, xDx to xCLK
2
—
2
—
ns
tH
Hold Time HIGH or LOW, xDx to xCLK
1.5
—
1.5
—
ns
tW
xCLK Pulse Width HIGH or LOW
5
—
6
—
ns
tSK(o)
Output Skew(3)
—
0.5
—
0.5
ns
FCT16374CT
FCT16374ET
Ind.
Mil.
Ind.
Mil.
Symbol
Parameter
Condition(2)
Min.(2)
Max.
Min.(2)
Max.
Min.(2)
Max.
Min.(2)
Max.
Unit
tPLH
PropagationDelay
CL = 50pF
2
5.2
2
6.2
1.5
3.7
—
ns
tPHL
xCLK to xOx
RL = 500
Ω
tPZH
OutputEnableTime
1.5
5.5
1.5
6.2
1.5
4.4
—
ns
tPZL
tPHZ
OutputDisableTime
1.5
5
1.5
5.7
1.5
3.6
—
ns
tPLZ
tSU
Set-up Time HIGH or LOW, xDx to xCLK
2
—
2
—
1.5
—
ns
tH
Hold Time HIGH or LOW, xDx to xCLK
1.5
—
1.5
—
0
—
ns
tW
xCLK Pulse Width HIGH or LOW
5
—
6
—
3(4)
——
—
ns
tSK(o)
Output Skew(3)
—
0.5
—
0.5
—
0.5
—
ns
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PDF描述 |
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