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参数资料
| 型号： | IDT74FCT377CTQG8 |
| 厂商： | INTEGRATED DEVICE TECHNOLOGY INC |
| 元件分类： | 锁存器 |
| 英文描述： | FCT SERIES, POSITIVE EDGE TRIGGERED D FLIP-FLOP, TRUE OUTPUT, PDSO20 |
| 封装： | GREEN, QSOP-20 |
| 文件页数： | 1/6页 |
| 文件大小： | 91K |
| 代理商： | IDT74FCT377CTQG8 |
INDUSTRIALTEMPERATURERANGE
IDT74FCT377AT/CT/DT
FASTCMOSOCTALDFLIP-FLOPWITHCLOCKENABLE
1
JUNE 2006
INDUSTRIAL TEMPERATURE RANGE
The IDT logo is a registered trademark of Integrated Device Technology, Inc.
2006 Integrated Device Technology, Inc.
DSC-2630/13
FEATURES:
A, C, and D grades
Low input and output leakage
≤≤≤≤≤1A (max.)
CMOS power levels
True TTL input and output compatibility:
–VOH = 3.3V (typ.)
–VOL = 0.3V (typ.)
High Drive outputs (-15mA IOH, 48mA IOL)
Meets or exceeds JEDEC standard 18 specifications
Power off disable outputs permit "live insertion"
Available in SOIC and QSOP packages
FUNCTIONAL BLOCK DIAGRAM
IDT74FCT377AT/CT/DT
FAST CMOS OCTAL
D FLIP-FLOP WITH
CLOCK ENABLE
DESCRIPTION:
The IDT74FCT377T is an octal D flip-flop built using an advanced dual
metal CMOS technology. The IDT74FCT377T has eight edge-triggered,
D-type flip-flops with individual D inputs and O outputs. The common
buffered Clock (CP) input loads all flip-flops simultaneously when the Clock
Enable (
CE) is low. The register is fully edge-triggered. The state of each
D input, one set-up time before the low-to-high clock transition, is transferred
to the corresponding flip-flop’s O output. The
CE input must be stable only
one set-up time prior to the low-to-high transition for predictable operation.
CE
CP
D
CP
Q
D 0
O 0
D
CP
Q
D 1
O 1
D
CP
Q
D 2
O 2
D
CP
Q
D 3
O 3
D
CP
Q
D 4
O 4
D
CP
Q
D 5
O 5
D
CP
Q
D 6
O 6
D
CP
Q
D 7
O 7
相关PDF资料 |
PDF描述 |
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