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参数资料
| 型号： | IDT74LVC16373APAG8 |
| 厂商： | IDT, Integrated Device Technology Inc |
| 文件页数： | 4/6页 |
| 文件大小： | 0K |
| 描述： | IC TRANSP LATCH 16BIT D 48-TSSOP |
| 标准包装： | 2,000 |
| 系列： | 74LVC |
| 逻辑类型： | D 型透明锁存器 |
| 电路： | 8:8 |
| 输出类型： | 三态 |
| 电源电压： | 2.3 V ~ 3.6 V |
| 独立电路： | 2 |
| 延迟时间 - 传输： | 2.1ns |
| 输出电流高，低： | 24mA，24mA |
| 工作温度： | -40°C ~ 85°C |
| 安装类型： | 表面贴装 |
| 封装/外壳： | 48-TFSOP（0.240"，6.10mm 宽） |
| 供应商设备封装： | 48-TSSOP |
| 包装： | 带卷 (TR) |
| 其它名称： | 74LVC16373APAG8 |
INDUSTRIALTEMPERATURERANGE
4
IDT74LVC16373A
3.3VCMOS16-BIT TRANSPARENT D-TYPE LATCH
OPERATING CHARACTERISTICS, VCC = 3.3V ± 0.3V, TA = 25°C
Symbol
Parameter
Test Conditions
Typical
Unit
CPD
Power Dissipation Capacitance per Latch Outputs enabled
CL = 0pF, f = 10Mhz
39
pF
CPD
Power Dissipation Capacitance per Latch Outputs disabled
6
SWITCHING CHARACTERISTICS(1)
VCC = 2.7V
VCC = 3.3V ± 0.3V
Symbol
Parameter
Min.
Max.
Min.
Max.
Unit
tPLH
PropagationDelay
—
4.9
1.6
4.2
ns
tPHL
xDx to xQx
tPLH
PropagationDelay
—
5.3
2.1
4.6
ns
tPHL
xLE to xQx
tPZH
OutputEnableTime
—
5.7
1.3
4.7
ns
tPZL
x
OE to xQx
tPHZ
OutputDisableTime
—
6.3
2.5
5.9
ns
tPLZ
x
OE to xQx
tSU
Set-up Time, data before LE
↓ HIGH or LOW
1.7
—
1.7
—
ns
tH
Hold Time, data after LE
↓ HIGH or LOW
1.2
—
1.2
—
ns
tW
Pulse Width LE HIGH
3.3
—
3.3
—
ns
tSK(o)
Output Skew(2)
——
—
500
ps
NOTES:
1.
See TEST CIRCUITS AND WAVEFORMS. TA = – 40°C to + 85°C.
2.
Skew between any two outputs of the same package and switching in the same direction.
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