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参数资料
| 型号： | IDT74SSTV16859NLG8 |
| 厂商： | IDT, Integrated Device Technology Inc |
| 文件页数： | 1/6页 |
| 文件大小： | 0K |
| 描述： | IC BUFFER 13-26BIT SSTL 56VFQFPN |
| 标准包装： | 3,000 |
| 系列： | 74SSTV |
| 逻辑类型： | 13 位至 26 位寄存缓冲器，带 SSTL_2 输入和输出 |
| 电源电压： | 2.3 V ~ 2.7 V |
| 位数： | 13，26 |
| 工作温度： | 0°C ~ 70°C |
| 安装类型： | 表面贴装 |
| 封装/外壳： | 56-VFQFN 裸露焊盘 |
| 供应商设备封装： | 56-VFQFP-EP（8x8） |
| 包装： | 带卷 (TR) |
| 其它名称： | 74SSTV16859NLG8 |
1
INDUSTRIALTEMPERATURERANGE
IDT74SSTV16859
13-BIT TO 26-BIT REGISTERED BUFFER WITH SSTL I/O
NOVEMBER
2008
2008 Integrated Device Technology, Inc.
DSC-5947/9
c
IDT74SSTV16859
INDUSTRIAL TEMPERATURE RANGE
FUNCTIONAL BLOCK DIAGRAM
13-BIT TO 26-BIT REGISTERED
BUFFER WITH SSTL I/O
DESCRIPTION:
The SSTV16859 is a 13-bit to 26-bit registered buffer designed for 2.3V-
2.7V VDD and supports low standby operation. All data inputs and outputs
are SSTL_2 level compatible with JEDEC standard for SSTL_2.
RESET is an LVCMOS input since it must operate predictably during the
power-up phase. RESET, which can be operated independent of CLK and
CLK, must be held in the low state during power-up in order to ensure
predictable outputs (low state) before a stable clock has been applied.
RESET, when in the low state, will disable all input receivers, reset all
registers,andforcealloutputstoalowstate,beforeastableclockhasbeen
applied. Withinputsheldlowandastableclockapplied,outputswillremain
low during the Low-to-High transition of RESET.
APPLICATIONS:
Ideally suited for DIMM DDR registered applications
FEATURES:
2.3V to 2.7V Operation
SSTL_2 Class II style data inputs/outputs
Differential CLK input
RESET control compatible with LVCMOS levels
Latch-up performance exceeds 100mA
ESD >2000V per MIL-STD-883, Method 3015; >200V using
machine model (C = 200pF, R = 0)
Available in 56 pin VFQFPN and 64 pin TSSOP packages
The IDT logo is a registered trademark of Integrated Device Technology, Inc.
51
48
49
45
35
R
1D
C1
16
Q1A
RESET
CLK
VREF
D1
TO 12 OTHER CHANNELS
32
Q1B
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