参数资料
型号: IDT74SSTV16859PAG
厂商: IDT, Integrated Device Technology Inc
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文件大小: 0K
描述: IC BUFFER 13-26BIT SSTL 64-TSSOP
产品变化通告: Product Discontinuation 09/Dec/2011
标准包装: 28
系列: 74SSTV
逻辑类型: 13 位至 26 位寄存缓冲器,带 SSTL_2 输入和输出
电源电压: 2.3 V ~ 2.7 V
位数: 13,26
工作温度: 0°C ~ 70°C
安装类型: 表面贴装
封装/外壳: 64-TFSOP (0.240",6.10mm 宽)
供应商设备封装: 64-TSSOP
包装: 管件
其它名称: 74SSTV16859PAG
5
INDUSTRIALTEMPERATURERANGE
IDT74SSTV16859
13-BIT TO 26-BIT REGISTERED BUFFER WITH SSTL I/O
TEST CIRCUITS AND WAVEFORMS (VDD = 2.5V ± 0.2V)
Voltage Waveforms - Pulse Duration
NOTES:
1. CL includes probe and jig capacitance.
2. IDD tested with clock and data inputs held at VDD or GND, and IO = 0mA.
3. All input pulses are supplied by generators having the following characteristics: PRR
≤10MHz, ZO = 50Ω, input slew rate = 1 V/ns ±20% (unless otherwise specified).
4. The outputs are measured one at a time with one transition per measurement.
5. VTT = VREF = VDDQ/2
6. VIH = VREF + 310mV (AC voltage levels) for differential inputs. VIH = VDD for LVCMOS input.
7. VIL = VREF - 310mV (AC voltage levels) for differential inputs. VIL = GND for LVCMOS input.
8. tPLH and tPHL are the same as tPD.
Load Circuit
Voltage Waveforms - Setup and Hold Times
Voltage Waveforms - Propagation Delay Times
Voltage and Current Waveforms
Inputs Active and Inactive Times
Timing
Input
VICR
VI(PP)
tPLH
tPHL
Output
VOH
VOL
VICR
VTT
VOH
VOL
VIH
VIL
tPHL
VDD/2
VTT
LVCMOS
RESET
Input
Output
VREF
VIH
VIL
VREF
Input
tW
VREF
VIH
VIL
VREF
Input
VICR
VI(PP)
tSU
tN
Timing
Input
From Output
Under Test
VTT
RL =50
Ω
CL =30pF
(see note 1)
Test Point
LVCMOS
RESET
Input
VDD/2
VDD
tINACT
tACT
IDD
VDD/2
90%
0V
(see note 2)
10%
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IDT74SSTVF16857PAG8 功能描述:IC BUFFER 14BIT SSTL I/O 48-TSSO RoHS:是 类别:集成电路 (IC) >> 逻辑 - 专用逻辑 系列:74SSTVF 产品变化通告:Product Discontinuation 25/Apr/2012 标准包装:1,500 系列:74SSTV 逻辑类型:DDR 的寄存缓冲器 电源电压:2.3 V ~ 2.7 V 位数:14 工作温度:0°C ~ 70°C 安装类型:表面贴装 封装/外壳:48-TFSOP(0.240",6.10mm 宽) 供应商设备封装:48-TSSOP 包装:带卷 (TR)
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