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参数资料
| 型号： | IDT79RC32H434-300BCI |
| 厂商： | IDT, Integrated Device Technology Inc |
| 文件页数： | 25/53页 |
| 文件大小： | 0K |
| 描述： | IC MPU 32BIT CORE 300MHZ 256-BGA |
| 标准包装： | 90 |
| 系列： | Interprise™ |
| 处理器类型： | MIPS32 32-位 |
| 速度： | 300MHz |
| 电压： | 1.2V |
| 安装类型： | 表面贴装 |
| 封装/外壳： | 256-LBGA |
| 供应商设备封装： | 256-CABGA（17x17） |
| 包装： | 托盘 |
| 其它名称： | 79RC32H434-300BCI |
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January 19, 2006
IDT RC32434
Figure 16 SPI AC Timing Waveform — Clock Polarity 0, Clock Phase 0
Figure 17 SPI AC Timing Waveform — Clock Polarity 0, Clock Phase 1
Signal
Symbol Reference
Edge
266MHz
300MHz
350MHz
400MHz
Unit
Condi-
tions
Timing
Diagram
Reference
Min
Max
Min
Max
Min
Max
Min
Max
SPI1
1. In SPI mode, the SCK period and sampling edge are programmable. In PCI mode, the SCK period is fixed and the sampling edge is rising.
SCK
Tper_15a
None
100
166667
100
166667
100
166667
100
166667
ns
SPI
See Figures
Thigh_15a,
Tlow_15a
40
83353
40
83353
40
83353
40
83353
ns
SPI
SDI
Tsu_15b
SCK rising or
falling
60
—
60
—
60
—
60
—
ns
SPI
See Figures
Thld_15b
60
—
60
—
60
—
60
—
ns
SPI
SDO
Tdo_15c
SCK rising or
falling
0600
60060
0
60
ns
SPI
SCK, SDI,
SDO
Tpw_15e
None
2(ICLK)
—
2(ICLK)
—
2(ICLK)
—
2(ICLK)
—ns
Bit I/O
Table 13 SPI AC Timing Characteristics
Tdo_15c
Thld_15b
Tsu_15b
Tlow_15a
Thigh_15a
Tper_15a
MSB
bit 6
bit 4
bit 5
bit 3
bit 2
bit 1
LSB
Control bits CPOL = 0, CPHA = 0 in the SPI Control Register, SPC.
MSB
bit 6
bit 4
bit 2
LSB
bit 5
bit 3
bit 1
SCK
SDI
SDO
Tdo_15c
Thld_15b
Tsu_15b
Tlow_15a
Thigh_15a
Tper_15a
MSB
bit 6
bit 4
bit 5
bit 3
bit 2
bit 1
LSB
Control bits CPOL = 0, CPHA = 1 in the SPI Control Register, SPC.
MSB
bit 6
bit 4
bit 5
bit 3
bit 1
bit 2
LSB
SCK
SDI
SDO
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