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参数资料
型号： IDT82V2108BBG
厂商： IDT, Integrated Device Technology Inc
文件页数： 7/292页
文件大小： 0K
描述： IC FRAMER T1/J1/E1 8CH 144-BGA
标准包装： 10
控制器类型： T1/E1/J1 调帧器
接口： 并联
电源电压： 2.97 V ~ 3.63 V
电流 - 电源： 160mA
工作温度： -40°C ~ 85°C
安装类型： 表面贴装
封装/外壳： 144-BGA
供应商设备封装： 144-PBGA（13x13）
包装： 托盘
其它名称： 82V2108BBG
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IDT82V2108
T1 / E1 / J1 OCTAL FRAMER
Operation
94
March 5, 2009
4OPERATION
4.1
E1 MODE
4.1.1
DEFAULT SETTING
When the device is powered-up, all the registers contain their
default values.
Any of the eight framers can be reset anytime when the RESET
(b0, E1-00AH / b0, T1/J1-00DH) in its framer is set. The device can also
be reset anytime when the RST pin is low for at least 100 ns.
After the hardware reset, the IDT82V2108 will default to the follow-
ing settings:
- Mode: the default operation mode of the device is T1 mode. When
the E1 mode is desired, the TEMODE (b0, 400H) must be set to logic 0.
- Receive Path: the default setting of each block in the receive path
is illustrated in Table 39.
- Transmit Path: the default setting of each block in the transmit
path is illustrated in Table 40.
Table 39: Default Setting in Receive Path in E1 Mode
Function Block
Default Setting Description
Line Interface
- LRDn inputs Non-Return to Zero (NRZ) data and is sampled on the rising edge of LRCKn.
- The RJAT Clock Divisors (N1, N2) are set to ‘2F’.
Frame Processor
- Basic Frame per G.704 with CRC Multi-Frame is enabled.
- Channel Associated Signaling is enabled.
HDLC Receiver #1, #2, #3
- RHDLCs are disabled.
Receive System Interface
- In the Receive Clock Slave External Signaling Mode.
- The data on the RSDn, RSSIGn pins is updated on the rising edge of RSCCK.
- RSCFS indicates Basic Frame Alignment.
- The RSDn, RSSIGn, RSFSn pins are held in high-impedance state.
PRGD
- The PRGD is configured to monitor the extracted data patterns in Frame 1.
Table 40: Default Setting in Transmit Path in E1 Mode
Function Block
Default Setting Description
PRGD
- The PRGD is configured to insert test patterns to Frame 1.
Transmit System Interface
- In the Transmit Clock Slave External Signaling Mode.
- The data on the TSDn and TSSIGn pins is sampled on the rising edge of TSCCKB.
Frame Generator
- CRC Multi-Frame is disabled.
- Channel Associated Signaling is enabled.
HDLC Transmitter #1, #2, #3
- THDLCs are disabled.
Line Interface
- LTDn outputs Non-Return to Zero (NRZ) data and is updated on the falling edge of LTCKn.
- TJAT Clock Divisors (N1, N2) are set to ‘2F’.
- Digital jitter attenuation is enabled. The PLL is synchronized to the TSCCKB clock. The smoothed clock output from
the PLL is selected as LTCKn.
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PDF描述
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参数描述
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IDT82V2108PX8 功能描述:IC FRAMER T1/J1/E1 8CH 128-PQFP RoHS:否 类别:集成电路 (IC) >> 接口 - 控制器 系列:- 标准包装:4,900 系列:- 控制器类型:USB 2.0 控制器 接口:串行 电源电压:3 V ~ 3.6 V 电流 - 电源:135mA 工作温度:0°C ~ 70°C 安装类型:表面贴装 封装/外壳:36-VFQFN 裸露焊盘 供应商设备封装:36-QFN（6x6） 包装:* 其它名称:Q6396337A
IDT82V2108PXG 功能描述:IC FRAMER T1/J1/E1 8CH 128-PQFP RoHS:是 类别:集成电路 (IC) >> 接口 - 控制器 系列:- 标准包装:4,900 系列:- 控制器类型:USB 2.0 控制器 接口:串行 电源电压:3 V ~ 3.6 V 电流 - 电源:135mA 工作温度:0°C ~ 70°C 安装类型:表面贴装 封装/外壳:36-VFQFN 裸露焊盘 供应商设备封装:36-QFN（6x6） 包装:* 其它名称:Q6396337A
IDT82V2108PXG8 功能描述:IC FRAMER T1/J1/E1 8CH 128-PQFP RoHS:是 类别:集成电路 (IC) >> 接口 - 控制器 系列:- 标准包装:4,900 系列:- 控制器类型:USB 2.0 控制器 接口:串行 电源电压:3 V ~ 3.6 V 电流 - 电源:135mA 工作温度:0°C ~ 70°C 安装类型:表面贴装 封装/外壳:36-VFQFN 裸露焊盘 供应商设备封装:36-QFN（6x6） 包装:* 其它名称:Q6396337A
IDT82V2604 制造商:IDT 制造商全称:Integrated Device Technology 功能描述:INVERSE MULTIPLEXING FOR ATM IDT82V2604
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