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参数资料
| 型号： | IDTCSP2510CPG8 |
| 厂商： | IDT, Integrated Device Technology Inc |
| 文件页数： | 5/9页 |
| 文件大小： | 0K |
| 描述： | IC PLL CLK DRIVER 3.3V 24-TSSOP |
| 标准包装： | 3,000 |
| 类型： | PLL 驱动器，零延迟缓冲器 |
| PLL： | 带旁路 |
| 输入： | 时钟 |
| 输出： | 时钟 |
| 电路数： | 1 |
| 比率 - 输入:输出： | 1:10 |
| 差分 - 输入:输出： | 无/无 |
| 频率 - 最大： | 140MHz |
| 除法器/乘法器： | 无/无 |
| 电源电压： | 3 V ~ 3.6 V |
| 工作温度： | 0°C ~ 85°C |
| 安装类型： | 表面贴装 |
| 封装/外壳： | 24-TSSOP（0.173"，4.40mm 宽） |
| 供应商设备封装： | 24-TSSOP |
| 包装： | 带卷 (TR) |
| 其它名称： | CSP2510CPG8 |
5
0C TO 85C TEMPERATURE RANGE
IDTCSP2510C
3.3V PHASE-LOCK LOOP CLOCK DRIVER
SWITCHING CHARACTERISTICS OVER OPERATING RANGE OF SUPPLY
VOLTAGE AND OPERATING FREE-AIR TEMPERATURE, CL = 30pF(1)
VDD = 3.3V ± 0.3V
Parameter (2)
From (Input)
To (Output)
Min.
Typ.
Max.
Unit
tPHASE error
100MHz < CLK
↑ < 133MHz
FBIN
↑
– 150
150
ps
tPHASEerror–jitter(3)
CLK
↑ = 133MHz
FBIN
↑
– 50
50
ps
tSK(o)(4)
Any Y (133MHz)
Any Y
150
ps
Jitter (cycle-cycle)
CLK = 133MHz
Any Y or FBOUT
– 75
75
ps
(peak-to-peak)
Duty cycle reference (5)
CLK = 133MHz
Any Y or FBOUT
45
55
%
tR
Any Y or FBOUT
0.8
2.1
ns
tF
Any Y or FBOUT
0.8
2.7
ns
NOTES:
1. For Industrial devices, operating free-air temperature = -40°C to +85°C. See PARAMETER MEASUREMENT INFORMATION.
2. The specifications for parameters in this table are applicable only after any appropriate stabilization time has elapsed.
3. Phase error does not include jitter.
4. The tSK(O) specification is only valid for equal loading of all outputs.
5. See TYPICAL CHARACTERISTICS.
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PDF描述 |
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参数描述 |
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