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参数资料
| 型号： | IDTCV132APV8 |
| 厂商： | INTEGRATED DEVICE TECHNOLOGY INC |
| 元件分类： | 时钟产生/分配 |
| 英文描述： | 200 MHz, PROC SPECIFIC CLOCK GENERATOR, PDSO56 |
| 封装： | GREEN, SSOP-56 |
| 文件页数： | 1/13页 |
| 文件大小： | 80K |
| 代理商： | IDTCV132APV8 |
COMMERCIALTEMPERATURERANGE
IDTCV132A
PROGRAMMABLEFLEXPC CLOCKFORP4PROCESSOR
1
JANUARY 2005
IDTCV132A
COMMERCIAL TEMPERATURE RANGE
PROGRAMMABLE FLEXPC
CLOCK FOR P4 PROCESSOR
3V66/PCI
Output Buffers
PCI[6:0], PCIF[2:0]
3V66[4:0]
SRC
PLL2
SSC
XTAL
Osc Amp
CPU CLK
Output Buffers
XTAL_IN
XTAL_OUT
IREF
CPU[2:0]
REF 1.0
PLL1
SSC
SM Bus
Controller
Watch Dog
Timer
Control
Logic
48MHz
Output Buffer
SDATA
SCLK
VTT_PWRGD
FSA,B
PWRDWN#
DOT48/USB48
VCH
PLL3
The IDT logo is a registered trademark of Integrated Device Technology, Inc.
2005 Integrated Device Technology, Inc.
DSC 6572/3
FEATURES:
3 PLL architecture
USB48 has 180° phase difference from DOT48 and VCH
3V66 lead PCI 1.5ns to 3.5ns
Band-gap circuit for differential output
High power-noise rejection ratio
100MHz to 200MHz CPU frequency
VCO frequency up to 1.1G
Support index block read/write
All CPU-Stop and PCI-Stop related functions are removed
Available in SSOP package
FUNCTIONAL BLOCK DIAGRAM
DESCRIPTION:
IDTCV132Aisa56pinclockdeviceforIntelspringdalechipsetandforIntel
advance P4 processors. This device also implements Band-gap referenced
IREF to reduce the impact of VDD variation on differential outputs, which can
provide more robust system performance.
KEY SPECIFICATIONS:
CPU/SRC CLK cycle to cycle jitter < 125ps
PCI CLK cycle to cycle jitter < 250ps
OUTPUTTABLE
CPU (Pair)
3V66
3V66/VCH
PCI
PCIF
REF
48MHz
SRC (Pair)
34
1
7
3
2
1
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