参数资料
型号: IP2001PBF
厂商: International Rectifier
文件页数: 2/10页
文件大小: 0K
描述: IC REG BUCK SYNC ADJ 20A 144BGA
标准包装: 10
系列: iPOWIR™
类型: 降压(降压)
输出类型: 可调式
输出数: 1
输出电压: 0.9 V ~ 3.3 V
输入电压: 3.3 V ~ 12 V
频率 - 开关: 150kHz ~ 1.0MHz
电流 - 输出: 20A
同步整流器:
工作温度: -40°C ~ 125°C
安装类型: 表面贴装
封装/外壳: 144-BGA(134 凸块)
包装: 管件
供应商设备封装: BGA(11x11)
iP2001PbF All specifications @ 25°C (unless otherwise specified)
Absolute Maximum Ratings :
Parameter
V IN to PGND
V DD to SGND
PWM to SGND
Enable to SGND
Output RMS Current
Storage Temperature
Min
-
-
-0.3
-0.3
-
-40
Typ
-
-
-
-
-
-
Max
16
6.0
V DD +0.3
V DD +0.3
20
125
Units
V
V
V
V
A
° C
Conditions
not to exceed 6.0V
not to exceed 6.0V
Recommended Operating Conditions :
Parameter
Supply Voltage
Input Voltage Range
Output Voltage Range
Output Current Range
Operating Frequency
Operating Duty Cycle
Symbol
V DD
V IN
V OUT
I OUT
fsw
D
Min
4.6
3.0
0.9
-
150
-
Typ
5.0
-
-
-
-
-
Max
5.5
12.6
3.3
20
1000
85
Units
V
V
V
A
kHz
%
Conditions
see Figs. 2 & 4
see Fig. 2
see Figs. 2 & 5
Electrical Specifications @ V DD = 5V (unless otherwise specified) :
Parameter
Block Power Loss ?
Turn On Delay ?
Turn Off Delay ?
V IN Quiescent Current
V DD Quiescent Current
Under Voltage Lockout
Start Threshold
Hysteresis
Enable
Input Voltage High
Input Voltage Low
Power Ready
Logic Level High
Logic Level Low
PWM nput
Logic Level High
Logic Level Low
Symbol
P BLK
t d(on)
t d(off)
I Q-VIN
I Q-VDD
UVLO
V START
V Hys-UVLO
Enable
V IH
V IL
PRDY
V OH
V OL
PWM
V OH
V OL
Min
-
-
-
-
-
4.2
-
2.0
-
4.5
-
2.0
-
Typ
3.1
63
26
-
-
4.4
.05
-
-
4.6
0.1
-
-
Max
3.8
-
-
1.0
10
4.5
-
-
0.8
-
0.2
-
0.8
Units
W
ns
mA
μ A
V
V
V
V
Conditions
V IN = 12V, V OUT = 1.6V,
I OUT = 20A, f SW = 500kHz
Enable = 0V, V IN = 12V
Enable = 0V, V DD = 5V
V DD = 4.6V, I Load = 10mA
V DD < UVLO Threshold, I Load = 1mA
? Measurement were made using four 10uF (TDK C3225X7R1C106M or equiv.) capacitors across the input (see
Fig. 8).
? Not associated with the rise and fall times. Does not affect Power Loss (see Fig. 9).
2 www.irf.com
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